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公开(公告)号：WO2017095195A1
公开(公告)日：2017-06-08
申请号：PCT/KR2016/014132
申请日：2016-12-02
Applicant: 삼성전자주식회사
Inventor： 유창훈 , 김원진 , 김현식 , 문선호 , 안민욱 , 김락기 , 조경수 , 사운시니쿤쥬 , 카푸르파리차이 , 아가왈판카즈 , 김원섭 , 김진효 , 김형훈 , 오지수 , 이경호 , 이승범 , 이진석 , 장동기 , 조수빈 , 칸살아뿌르브
IPC: G06F9/50 , G06F12/02 , G06F12/0882
CPC classification number: G06F9/50 , G06F12/02 , G06F12/0882
Abstract: 본 개시는 다양한 상황에서 시스템 리소스 관리에 관한 것이다. 본 개시에서는 전자 장치가 데이터에 대한 특정 연산을 위해 패딩(padding)을 할 경우 메모리 요구량을 줄이고 처리 속도를 향상시키기 방법 및 장치를 제공한다. 상술한 목적을 달성하기 위한 본 개시에서 전자 장치의 동작 방법은, 제1 메모리로부터 데이터의 제1 일부를 읽는 과정과, 제1 일부에 포함된 다수의 바이트들 중 데이터의 경계 영역에 속하는 바이트의 주소에 기반하여 제1 패딩 주소를 결정하는 과정과, 다수의 바이트들의 값과 제1 패딩 주소에 대응하는 값을 제2 메모리에 쓰는 과정과, 제1 메모리로부터 데이터의 제2 일부를 읽는 과정을 포함한다.
Abstract translation: 本公开涉及在各种情况下的系统资源管理。 本公开提供了一种用于在电子设备针对数据进行特定操作时进行缓冲时减少存储器需求并提高处理速度的方法和装置。 根据本发明的另一方面，提供了一种操作电子设备的方法，包括：从第一存储器读取第一部分数据; 基于所述第一读取到处理的第二部分以及从所述第一存储器中的数据的地址写入对应于该方法的第一填补地址的值的值，并且多个字节，以确定填补地址到第二存储器
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公开(公告)号：KR1020160070631A
公开(公告)日：2016-06-20
申请号：KR1020140177830
申请日：2014-12-10
Applicant: 삼성전자주식회사
CPC classification number: G06F8/4441 , G06F8/441 , G06F9/06 , G06F12/02 , Y02D10/32
Abstract: 명령어처리방법은, 프로그램을구성하는변수의사용빈도에따라상기변수의우선순위를결정하는단계; 상기우선순위에따라, 메모리에상기변수의값이저장되는주소를결정하는단계; 및상기주소의비트열의길이에따라상기변수에대한명령어를결정하는단계를포함할수 있다.
Abstract translation: 一种用于处理指令的方法包括：基于构成程序的变量的使用频率来确定变量的优先级的步骤; 基于优先级确定其中存储变量值的存储器的地址的步骤; 以及根据地址的位串的长度来确定关于变量的指令的步骤。 根据本发明，通过减少频繁地用于变量的指令的数量，可以提高程序性能。
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公开(公告)号：KR1020160029588A
公开(公告)日：2016-03-15
申请号：KR1020140119362
申请日：2014-09-05
Applicant: 삼성전자주식회사 , 서울대학교산학협력단
CPC classification number: G06F17/30377 , G06F17/30536 , G06F17/30958
Abstract: 루프(loop)가포함하는명령어들간의의존관계를포함하는데이터의존성그래프(dependence graph)를획득하고데이터의존성그래프에서, 사이클을형성하는명령어들의집합인리커런스(recurrence)를탐색하고, 리커런스의처리순서를결정하는스케줄링하고, 리커런스를탐색하는것은이터레이션디스턴스(Iteration Distance)의합이소정의임계값보다작은리커런스만을탐색하고, 이터레이션디스턴스는리커런스에포함된소정의명령어를처리한후 소정의명령어의처리결과에의존하는다른명령어를처리할수 있을때까지소요되는이터레이션횟수인모듈로스케줄링방법이개시된다.
Abstract translation: 公开了一种模调度方法，包括以下步骤：获得包括在循环中包括的命令之间的依赖性的数据依赖图; 搜索在数据依赖图中形成循环的一组命令的重复; 并调度以确定复发的处理顺序。 搜索重复仅搜索迭代距离之和小于预定临界值的重复。 迭代距离是在处理包含在重复中的预定命令之后可以处理依赖于处理预定命令的结果的另一命令而执行的迭代次数。
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公开(公告)号：KR1020120109739A
公开(公告)日：2012-10-09
申请号：KR1020110027032
申请日：2011-03-25
Applicant: 삼성전자주식회사
CPC classification number: G06F15/7892 , G06F8/4452 , G06F8/451 , G06F9/30054 , G06F9/30076 , G06F9/30189 , G06F9/325 , G06F9/3889 , G06F8/52 , G06F9/3004 , G06F9/30072 , G06F9/38 , G06F17/5054
Abstract: PURPOSE: A reconfigurable processor, a code conversion apparatus VLIW, and a method thereof are provided to selectively map a code area where does not apply software pipelining to a VLIW mode or a CGA mode according to degree of parallelism. CONSTITUTION: A processing unit(101) includes a VLIW(Very Long Instruction Word) and a CGA(Coarse-Grained Array) mode. A controlling unit(103) detects a target region from a code which is executable from the processing unit. The controlling unit maps the detected target area to the VLIW mode or the CGA mode according to the schedule length of the detected target area. The target area is defined as a part which does not apply software pipelining in the code. [Reference numerals] (102) Mode control unit; (103) Controlling unit; (104) VLIW memory; (105) Configuring memory; (106) Central register file
Abstract translation: 目的：提供可重构处理器，代码转换装置VLIW及其方法，以根据并行度选择性地将不应用软件流水线的代码区域映射到VLIW模式或CGA模式。 构成：处理单元（101）包括VLIW（超长指令字）和CGA（粗粒子阵列）模式。 控制单元（103）从可从处理单元执行的代码检测目标区域。 控制单元根据检测到的目标区域的调度长度将检测到的目标区域映射到VLIW模式或CGA模式。 目标区域被定义为在代码中不应用软件流水线的部分。 （附图标记）（102）模式控制单元; （103）控制单元; （104）VLIW存储器; （105）配置内存; （106）中央登记档案
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公开(公告)号：KR1020160003485A
公开(公告)日：2016-01-11
申请号：KR1020140081990
申请日：2014-07-01
Applicant: 삼성전자주식회사
Abstract: 원격함수호출(Remote Procedure Call: RPC)을수행할부분을나타내는정보를포함하는소스코드를획득하고, 상기 RPC를수행할부분을나타내는정보를포함하는소스코드를분석하여, RPC 호출을위한코드및 RPC 함수실행을위한코드를생성하는원격함수호출을위한코드생성방법이개시된다.
Abstract translation: 公开了一种用于远程过程调用（RPC）的代码生成方法，包括以下步骤：获取包括用于显示RPC的执行部分的信息的源代码; 并分析包括RPC执行部分的源代码，生成RPC代码或执行RPC功能。
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Patent Agency Ranking
公开(公告)号：KR1020140033616A
公开(公告)日：2014-03-19
申请号：KR1020120099609
申请日：2012-09-07
Applicant: 삼성전자주식회사
CPC classification number: G06F11/3624 , G06F8/41 , G06F11/3612 , G06F11/3672
Abstract: Disclosed are an apparatus and method for detecting a source code error location in a mixed-mode program, capable of providing source level debugging information without applying complex algorithm. An apparatus for detecting a source code error location in a mixed-mode program according to an embodiment comprises: a compiler unit which generates a first program by compiling a source code in a first mode, and generates a second program by compiling the source code in a second mode; a mapping table generation unit which generates a first mapping table for the first program, and a second mapping table for the second program; a simulation unit which simulates the first program and simulates the second program; a low-level data extraction unit which extracts first low-level data on the first program during the simulation of the first program, and extracts second low-level data on the second program during the simulation of the second program; a comparison data generation unit which maps the first low-level data onto the first mapping table to generate a verification target mapping table, and maps the second low-level data onto the second mapping table to generate a reference mapping table; and an error location detection unit which compares the verification target mapping table with the reference mapping table to determine whether there is an inconsistent record of data, and if so, obtains program location information relating to the record. [Reference numerals] (AA) Start; (BB) End; (S100) Compile step; (S110) Simulation and low level data extraction step; (S120) Comparison data generation step; (S130) Error location detection step
Abstract translation: 公开了一种用于检测混合模式程序中的源代码错误位置的装置和方法，能够提供源级调试信息而不应用复杂算法。 根据实施例的用于检测混合模式程序中的源代码错误位置的装置包括：编译单元，其通过以第一模式编译源代码来生成第一程序，并且通过将源代码编译成 第二种模式; 生成第一程序的第一映射表和第二程序的第二映射表的映射表生成单元， 模拟单元，其模拟第一程序并模拟第二程序; 低级数据提取单元，其在第一程序的模拟期间提取第一程序的第一低级数据，并且在第二程序的模拟期间提取关于第二程序的第二低级数据; 比较数据生成单元，将第一低级数据映射到第一映射表上，生成验证对象映射表，将第二低级数据映射到第二映射表，生成参照映射表; 以及错误位置检测单元，其将验证目标映射表与参考映射表进行比较，以确定是否存在不一致的数据记录，如果是，则获得与记录相关的节目位置信息。 （附图标记）（AA）开始; （BB）结束; （S100）编译步骤; （S110）模拟和低电平数据提取步骤; （S120）比较数据生成步骤; （S130）错误位置检测步骤
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公开(公告)号：KR1020130051821A
公开(公告)日：2013-05-21
申请号：KR1020110117186
申请日：2011-11-10
Applicant: 삼성전자주식회사
CPC classification number: G06F9/5016 , G06F9/461
Abstract: PURPOSE: A method for transmitting vector register file data and a core system with improved interrupted speed delays are provided to prevent transmission delays generated in a process which stores and recovers the vector register file data based on the hardware data transmitting device when an interruption is generated, thereby improving the interrupted speed delays of the core system. CONSTITUTION: A second memory(120) has large capacity in comparison to a first memory(110). A vector register file is vector register sets. A core(140) determines whether or not a first memory stores the vector register file data of being executed when the interruption is generated. The core generates a first command or a second command which stores the vector register file data corresponding to a determination result. A data transmitting device(150) reads the vector register file data from the vector register file and stores the same in the second memory. [Reference numerals] (110) First memory; (120) Second memory; (130) Vector register file; (140) Core; (150) Data transmitting device; (160) Scalar register file; (170) Data memory controller
Abstract translation: 目的：提供一种用于传输向量寄存器文件数据的方法和具有改进的中断速度延迟的核心系统，以防止在产生中断时基于硬件数据发送设备存储和恢复向量寄存器文件数据的过程中产生的传输延迟 ，从而提高核心系统的中断速度延迟。 构成：与第一存储器（110）相比，第二存储器（120）具有大的容量。 向量寄存器文件是向量寄存器集。 核心（140）确定第一存储器是否存储当产生中断时正在执行的向量寄存器文件数据。 核心产生存储对应于确定结果的向量寄存器文件数据的第一命令或第二命令。 数据发送装置（150）从向量寄存器文件读取向量寄存器文件数据并将其存储在第二存储器中。 （附图标记）（110）第一存储器; （120）第二存储器; （130）向量寄存器文件; （140）核心; （150）数据发送装置; （160）标量寄存器文件; （170）数据存储控制器
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公开(公告)号：KR1020120040630A
公开(公告)日：2012-04-27
申请号：KR1020100109998
申请日：2010-11-05
Applicant: 삼성전자주식회사
Abstract: PURPOSE: A reconfigurable processor to handle a memory dependent loop and a method thereof are provided to analyze the dependency between memory access commands, thereby allocating the commands to a plurality of processing elements based on the analyzed result. CONSTITUTION: An extracting unit(140) extracts an operation trace from a simulation result. A scheduler(150) analyzes the memory dependency between commands of iterations based on a corresponding trace to a memory access command out of the operation traces. A simulation unit(130) simulates the commands. The scheduler analyzes the memory dependency between the commands of iterations which exist in a generated iteration window.
Abstract translation: 目的：提供用于处理存储器相关环路的可重构处理器及其方法，以分析存储器访问命令之间的依赖关系，从而基于分析结果将命令分配给多个处理元件。 构成：提取单元（140）从仿真结果提取操作轨迹。 调度器（150）基于与操作轨迹之间的存储器访问命令的对应轨迹来分析迭代命令之间的存储器依赖性。 模拟单元（130）模拟命令。 调度器分析生成的迭代窗口中存在的迭代命令之间的内存依赖关系。
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公开(公告)号：KR1020060010004A
公开(公告)日：2006-02-02
申请号：KR1020040058555
申请日：2004-07-27
Applicant: 재단법인서울대학교산학협력재단 , 삼성전자주식회사
IPC: G06F9/38
CPC classification number: G06F8/4434
Abstract: 본 발명은 하나의 명령으로 메모리에 저장되어 있는 복수 개의 데이터들을 전달하는 방안을 제안한다. 이를 위해 각 영역별로 어드레스가 할당된 적어도 2개의 영역들로 구성된 메모리에서, 데이터들을 각 어드레스에 순차적으로 할당하고, 상기 어드레스 할당된 데이터들을 하나의 명령으로 전달하게 된다. 즉, 하나의 명령으로 구성하고 있는 데이터들을 전달하는 적어도 하나의 블록을 생성하고, 데이터를 상기 블록들 중 적어도 하나의 블록에 구성되도록 지시한다. 상기 블록을 구성하고 있는 데이터들을 상호 연결하고, 상기 블록들에 대해 동일한 데이터들을 상호 연결한 경로의 합들을 산출하고, 상기 연결한 경로의 합을 고려하여 상기 데이터들을 최소 경로로 연결한다. 상기 최소 경로를 이용하여 상기 데이터들을 어드레스별로 순차적으로 할당한다.
메모리, 레지스터, 어드레스, MLS -
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