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    Codificador, descodificador, método de codificação e método de decodificação
    78.
    发明专利
    Codificador, descodificador, método de codificação e método de decodificação 未知

    公开(公告)号：BR112021021364A2

    公开(公告)日：2022-04-26

    申请号：BR112021021364

    申请日：2020-06-09

    Applicant: PANASONIC IP CORP AMERICA

    Inventor： ABE KIYOFUMI ,  TOMA TADAMASA ,  NISHI TAKAHIRO ,  KATO YUSUKE

    IPC: H04N19/13

    Abstract: codificador, descodificador, método de codificação e método de decodificação. um codificador (100) inclui loops e memória acoplada aos loops. em operação, o loop limita um número total de processos de codificação adaptativa de contexto e codifica um bloco em uma imagem; e ao codificar o bloco, em um caso onde transformação ortogonal é aplicada ao bloco e em um caso onde nenhuma transformação ortogonal é aplicada ao bloco, codifica um sinalizador de informação sobre coeficiente através de codificação adaptativa de contexto quando o número total de processos está dentro de uma faixa permitida para o número total de processos, ignora a codificação do sinalizador de informação sobre coeficiente quando o número total de processos não está dentro da faixa permitida, codifica informação sobre valor restante através de codificação de golomb-rice quando o sinalizador de informação sobre coeficiente é codificado, quando a codificação do sinalizador de informação sobre coeficiente é ignorada no caso onde transformação ortogonal é aplicada ao bloco, executa um processo de conversão e codifica o valor de coeficiente através de codificação de golomb-rice e, quando a codificação do sinalizador de informação sobre coeficiente é ignorada no caso onde nenhuma transformação ortogonal é aplicada ao bloco, ignora a execução do processo de conversão e codifica o valor de coeficiente através de codificação de golomb-rice.

    Codificador, decodificador e mídia legível por computador não transitória
    79.
    发明专利
    Codificador, decodificador e mídia legível por computador não transitória 未知

    公开(公告)号：BR122021025020A2

    公开(公告)日：2022-03-15

    申请号：BR122021025020

    申请日：2020-05-20

    Applicant: PANASONIC IP CORP AMERICA

    Inventor： ABE KIYOFUMI ,  TOMA TADAMASA ,  NISHI TAKAHIRO ,  DRUGEON VIRGINIE ,  KATO YUSUKE

    IPC: H04N19/70

    Abstract: codificador, decodificador e mídia legível por computador não transitória. a presente invenção refere-se a um conjunto de circuitos (160) de um codificador (100) que é configurado para codificar uma imagem de acordo com uma estrutura de codificação, incluindo uma figura de ponto de acesso aleatório intra (irap), figura dianteiras a serem emitidas antes da figura de irap na ordem de emissão e figuras traseiras a serem emitidas após a figura de irap na ordem de emissão. quando a imagem é codificada, o conjunto de circuitos (160) codifica, de acordo com uma sinalização em um fluxo de bits, no máximo uma figura traseira entre as figuras traseiras antes de codificar as figuras dianteiras na ordem de codificação, e codifica as figuras traseiras diferentes de, no máximo, uma figura traseira após codificação das figuras dianteiras na ordem de codificação. a sinalização indica se uma imagem de cada uma das unidades de acesso no fluxo de bits é uma figura de campo. o conjunto de circuitos (160) codifica no máximo uma figura traseira antes de codificar as figuras dianteiras na ordem de codificação quando a sinalização indica que a figura é uma figura de campo.

    Codificador, decodificador, método de codificação e método de decodificação
    80.
    发明专利
    Codificador, decodificador, método de codificação e método de decodificação 未知

    公开(公告)号：BR112021026080A2

    公开(公告)日：2022-02-08

    申请号：BR112021026080

    申请日：2020-08-28

    Applicant: PANASONIC IP CORP AMERICA

    Inventor： KIYOFUMI ABE ,  SAITOU HIDEO ,  OHKAWA MASATO ,  TOMA TADAMASA ,  NISHI TAKAHIRO ,  KATO YUSUKE

    IPC: H04N19/70 ,  H04N19/85

    Abstract: codificador, decodificador, método de codificação e método de decodificação. é fornecido um codificador (100) que inclui: conjunto de circuitos (a1); e memória (a2) acoplada ao conjunto de circuitos (a1). em operação, o conjunto de circuitos (a1): realiza um processo de mapeamento de mapeamento de luma com escalonamento de croma (lmcs) para transformar um primeiro espaço de valor de pixel aplicado a um sinal de imagem de exibição de luma em um segundo espaço de valor de pixel aplicado a um sinal de processo de codificação luma, usando segmentos de linha que formam uma curva de transformada, em que cada uma das quais corresponde a uma seção diferente dentre as seções obtidas pela partição do primeiro espaço de valor de pixel; e codifica uma imagem, e na realização do lmcs, o conjunto de circuitos determina a curva de transformada de modo que dentre os valores de limite no segundo espaço de valor de pixel que estão localizados nos limites entre os segmentos de linha, um primeiro valor obtido pela divisão de um valor de limite por uma largura de base definida de acordo com uma profundidade de bits da imagem não seja igual a um segundo valor obtido dividindo-se outro valor de limite pela largura de base.

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