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公开(公告)号：KR101719485B1
公开(公告)日：2017-03-27
申请号：KR1020100092377
申请日：2010-09-20
Applicant: 삼성전자주식회사
CPC classification number: G06T15/40
Abstract: 그래픽처리유닛에서의사전픽셀제거를위한장치및 방법이제공된다. 디스카드명령어에의해디스카드될수 있는픽셀에대해서는깊이값을갱신하지않는사전깊이검사가수행되고, 디스카드명령어에의해디스카드되지않는픽셀에대해서는깊이값을갱신하는사전깊이검사가수행된다. 사전깊이검사에의해픽셀쉐이딩처리대상이되는픽셀의수가감소된다.
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公开(公告)号：KR101511273B1
公开(公告)日：2015-04-10
申请号：KR1020080135491
申请日：2008-12-29
Applicant: 삼성전자주식회사
CPC classification number: G06T15/005
Abstract: 멀티코어프로세서를이용한 3차원그래픽렌더링방법및 시스템을개시한다. 스크래치패드메모리(Scratch Pad Memory)를포함하는복수개의코어, 컨트롤플로우를수행하기위한제1 메모리, 루프가속을위한제2 메모리및 상기복수개의코어와연동하는공유메모리를포함한다.
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公开(公告)号：KR101228110B1
公开(公告)日：2013-01-31
申请号：KR1020060070454
申请日：2006-07-26
Applicant: 삼성전자주식회사
IPC: G06T15/04
CPC classification number: G06T3/4007
Abstract: 복수의 평면으로 구성된 입체상의 한 지점의 영상 정보를 보간하는 본 발명에 의한 영상 보간 방법은, 상기 지점에 가장 인접한 상기 평면을 검색하고, 상기 검색된 평면과 마주보는 상기 평면의 하나 이상의 정점의 영상 정보를 이용하여 대향면 정보를 구하고, 상기 검색된 평면의 하나 이상의 정점의 영상 정보 및 상기 구해진 대향면 정보를 이용하여 상기 지점의 영상 정보를 보간함으로써, 신뢰할 수 있는 보간값을 신속히 획득하는 효과를 갖는다.
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公开(公告)号：KR1020120034293A
公开(公告)日：2012-04-12
申请号：KR1020100095752
申请日：2010-10-01
Applicant: 삼성전자주식회사
IPC: G06T17/00
CPC classification number: G06T15/005 , G06T15/80 , G06T17/20 , G06T17/00
Abstract: PURPOSE: A vertex processing method and a device thereof are provided to selectively fetch and shade necessary property information of a vertex. CONSTITUTION: A vertex processing device fetches the location information of vertexes(815). The vertex processing device outputs the target location information of primitives which are displayed on a view port from the fetched location information. The vertex processing device outputs a tile binning result by the tile binning of the target location information(860). The vertex processing device fetches and shades the property information of the vertexes corresponding to the target location information(845,850).
Abstract translation: 目的：提供顶点处理方法及其装置，以选择性地获取和遮蔽顶点的必要属性信息。 构成：顶点处理设备获取顶点的位置信息（815）。 顶点处理装置从获取的位置信息输出在视图端口上显示的图元的目标位置信息。 顶点处理装置通过目标位置信息的瓦片合并输出瓦片合并结果（860）。 顶点处理装置取出并遮蔽对应于目标位置信息的顶点的属性信息（845,850）。
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公开(公告)号：KR1020120030700A
公开(公告)日：2012-03-29
申请号：KR1020100092377
申请日：2010-09-20
Applicant: 삼성전자주식회사
Abstract: PURPOSE: An apparatus for early fragment discarding in a graphic processing unit and a method thereof are provided to perform prior depth inspections with updating the depth value and without updating the depth value. CONSTITUTION: A discard shading processing unit(740) performs previous depth inspection maintaining a depth value. The discard shading processing unit selectively eliminates the pixel by processing a discard shader(744). A pixel shading processor(750) performs the prior depth inspection which updates the depth value. The pixel shading processing unit selectively eliminates the pixel. The pixel shading processing unit processes the pixel with the use of the pixel shader(754).
Abstract translation: 目的：提供一种用于在图形处理单元中进行早期片段丢弃的装置及其方法，用于通过更新深度值并且不更新深度值来执行先前的深度检查。 构成：丢弃遮蔽处理单元（740）执行保持深度值的先前深度检查。 丢弃着色处理单元通过处理丢弃着色器来选择性地消除像素（744）。 像素着色处理器（750）执行更新深度值的先前深度检查。 像素着色处理单元选择性地消除像素。 像素着色处理单元使用像素着色器来处理该像素（754）。
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Patent Agency Ranking
公开(公告)号：KR1020110058971A
公开(公告)日：2011-06-02
申请号：KR1020090115537
申请日：2009-11-27
Applicant: 삼성전자주식회사
IPC: G06F15/163 , G06F1/00 , H04L12/28 , G06K19/07
Abstract: PURPOSE: A computer chips and information routing method thereof are provided to implement on-chip data transfer between intelligent devices by connecting a router to an intelligent device in a tree-structure. CONSTITUTION: Router groups include routers that are connected to a tree structure. A bridge line(120) interlinks a first router included in a first router group(210) and a second router included in a second router group(220). An intelligent component(130) is connected to the router and exchanges information through the router. A bridge line is connected to the router having a connection relation with the first router and the second router.
Abstract translation: 目的：提供一种计算机芯片和信息路由方法，通过将路由器以树状结构连接到智能设备，实现智能设备之间的片上数据传输。 规定：路由器组包括连接到树结构的路由器。 桥接线路（120）将包括在第一路由器组（210）中的第一路由器和包括在第二路由器组（220）中的第二路由器互连。 智能组件（130）连接到路由器并通过路由器交换信息。 桥接线路连接到与第一路由器和第二路由器具有连接关系的路由器。
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公开(公告)号：KR1020100048597A
公开(公告)日：2010-05-11
申请号：KR1020080107831
申请日：2008-10-31
Applicant: 삼성전자주식회사
CPC classification number: G06F12/0888 , G06F12/08 , G06F2212/251 , G06F2212/253
Abstract: PURPOSE: A processor and method for controlling a memory are provided to improve a data processing speed as a processor by performing data preparation procedure and data processing procedure respectively. CONSTITUTION: Based on the data request command of a processor core(110), a data management unit(120) reads out the data from an external memory(140). The data management unit converts the read data into batch data, and a scratch pad memory(130) stores the converted batch memory. The data management unit reads out the data through a 1st path, and the 1st path is connected to the external memory through a data cache(121).
Abstract translation: 目的：提供一种用于控制存储器的处理器和方法，以通过分别执行数据准备过程和数据处理过程来提高作为处理器的数据处理速度。 构成：根据处理器核心（110）的数据请求命令，数据管理单元（120）从外部存储器（140）读出数据。 数据管理单元将读取的数据转换成批量数据，而临时存储器（130）存储转换的批量存储器。 数据管理单元通过第一路径读出数据，第一路径通过数据高速缓存（121）连接到外部存储器。
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公开(公告)号：KR1020090028337A
公开(公告)日：2009-03-18
申请号：KR1020070093849
申请日：2007-09-14
Applicant: 삼성전자주식회사
CPC classification number: G06T15/005
Abstract: A vertex data processing apparatus and a method thereof are provided to output batches stored in a buffer so that a processor immediately processes them when all batches, being processed in the processor, are processed. The first storage unit(200) stores vertex data. The second storage unit(220) stores vertex data corresponding to a preset processing unit among the stored vertex data. A processing unit(230) processes vertex data stored in the second storage unit. While the processing unit is processing the vertex data corresponding to the preset processing unit, an extracting unit(210) extracts vertex data which will be processed next as corresponding to the preset processing unit from the first storage unit and temporarily stores the extracted results.
Abstract translation: 提供顶点数据处理装置及其方法来输出存储在缓冲器中的批次，使得处理器中处理的所有批次处理时，处理器立即处理它们。 第一存储单元（200）存储顶点数据。 第二存储单元（220）存储对应于存储的顶点数据中的预设处理单元的顶点数据。 处理单元（230）处理存储在第二存储单元中的顶点数据。 当处理单元正在处理与预设处理单元相对应的顶点数据时，提取单元（210）从第一存储单元提取将被处理的下一个对应于预设处理单元的顶点数据，并临时存储所提取的结果。
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公开(公告)号：KR1020080078131A
公开(公告)日：2008-08-27
申请号：KR1020070017775
申请日：2007-02-22
Applicant: 삼성전자주식회사
CPC classification number: G06F8/443 , G06F8/447 , G06F12/0207
Abstract: A method for accessing a memory with 3D(Dimensional) address mapping is provided to enable a triple loop included in a program to access a LAM(Linear Addressable Memory) efficiently by using the 3D address mapping and map a linear address to a 3D address suitable for address calculation of the memory accessed by the tripe loop. 'a', 'b', and 'c' are obtained from a code accessing a memory by a triple loop included in a program(810). 'a', 'b', and 'c' are the number available to a loop parameter of the innermost loop, a middle loop, and the outmost loop of the triple loop. A start address of the memory accessed by the tripe loop is obtained(820). 'aXbXc' addresses of the memory accessed by the triple loop are obtained by using the start address and a predetermined formula(830). A linear address of the memory is mapped to an (x,y,z) 3D address.
Abstract translation: 提供了一种使用3D（维度）地址映射来访问存储器的方法，以使程序中包含的三重循环能够通过使用3D地址映射有效地访问LAM（线性可寻址存储器），并将线性地址映射到适合的3D地址 用于由tripe循环访问的存储器的地址计算。 通过包含在程序（810）中的三重循环的访问存储器的代码获得'a'，'b'和'c'。 'a'，'b'和'c'是可循环参数的最多循环，中间循环和最后一个循环的循环次数。 获得由tripe循环访问的存储器的起始地址（820）。 通过使用起始地址和预定公式（830）获得由三重环路访问的存储器的'aXbXc'地址。 存储器的线性地址映射到（x，y，z）3D地址。
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公开(公告)号：KR101388134B1
公开(公告)日：2014-04-23
申请号：KR1020070098952
申请日：2007-10-01
Applicant: 삼성전자주식회사
CPC classification number: G06F9/30043 , G06F9/3824 , G06F9/3836
Abstract: 본 발명에 의한 뱅크 충돌 방지 장치 및 방법은, 뱅크 충돌을 야기시킬 것으로 예상되는 억세스 명령들 중 하나인 제1 명령의 실행 시점을, 그 억세스 명령들이 뱅크 충돌을 야기시키지 않게 되도록 제1 명령의 실행 시점의 이전 시점으로 변경함으로써 제1 명령을 제2 명령으로 변경한 뒤, 당초에는 제1 명령에 따라 뱅크에 억세스될 예정이었던 기입독출부가 그 뱅크에 제2 명령의 실행 시점에 억세스하여 그 뱅크로부터 데이터를 독출한 뒤, 제1 명령의 실행 시점에야 비로소 그 독출된 데이터를 입력받도록 한다. 이에 따라, 본 발명에 의한 뱅크 충돌 방지 장치 및 방법은, 뱅크 충돌을 야기시킬 것으로 예상되는 억세스 명령들이 기입독출부들에 대해 주어지더라도, 뱅크 충돌이 실제로 발생되는 것을 막음으로써, 뱅크 충돌의 발생으로 인해 프로세서의 성능이 떨어지는 것을 방지하는 효과를 갖는다.
뱅크, 스케쥴링, 선취
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