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公开(公告)号：KR1020060008004A
公开(公告)日：2006-01-26
申请号：KR1020040057642
申请日：2004-07-23
Applicant: 삼성전자주식회사
IPC: H03L7/10
Abstract: 본 발명은 위상검출기를 개시한다. 위상검출기는 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호의 제1레벨에서 데이터신호를 패스하고 제2레벨에서 홀드하여 복수의 제1저장 데이터신호들을 생성하는 제1저장부와, 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호와 위상이 반전된 클록신호의 제1레벨에서 대응하는 제1저장데이터신호를 패스하고 제2레벨에서 홀드하여 복수의 제2저장 데이터신호를을 생성하는 제2저장부를 포함한다. 또한, 복수의 제1저장 데이터신호들 중 한 쌍씩 각각 배타적 논리합하여 복수의 에러검출신호들을 생성하는 에러신호 검출부와, 복수의 제2저장데이터신호들 중 한 쌍씩 각각 배타적 논리합하여 복수의 기준검출신호들을 생성하는 기준신호 검출부를 포함한다. 또한, 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호의 제1레벨에서 복수의 에러검출신호들 중 대응하는 에러신호를 선택하고 제2레벨에서 차단하여 복수의 에러신호들을 발생하는 제1스위칭부와, 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호의 제1레벨에서 상기 복수의 기준검출신호들 중 대응하는 기준신호를 선택하고 제2레벨에서 차단하여 복수의 기준신호들을 발생하는 제2스위칭부를 포함한다. 따라서, 단위동작시간보다 긴 폭을 가진 에러신호와 기준신호를 생성함으로써 보다 고속 동작이 가능하다.
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公开(公告)号：KR100630333B1
公开(公告)日：2006-10-02
申请号：KR1020040057642
申请日：2004-07-23
Applicant: 삼성전자주식회사
IPC: H03L7/10
Abstract: 본 발명은 위상검출기를 개시한다. 위상검출기는 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호의 제1레벨에서 데이터신호를 패스하고 제2레벨에서 홀드하여 복수의 제1저장 데이터신호들을 생성하는 제1저장부와, 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호와 위상이 반전된 클록신호의 제1레벨에서 대응하는 제1저장데이터신호를 패스하고 제2레벨에서 홀드하여 복수의 제2저장 데이터신호를을 생성하는 제2저장부를 포함한다. 또한, 복수의 제1저장 데이터신호들 중 한 쌍씩 각각 배타적 논리합하여 복수의 에러검출신호들을 생성하는 에러신호 검출부와, 복수의 제2저장데이터신호들 중 한 쌍씩 각각 배타적 논리합하여 복수의 기준검출신호들을 생성하는 기준신호 검출부를 포함한다. 또한, 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호의 제1레벨에서 복수의 에러검출신호들 중 대응하는 에러신호를 선택하고 제2레벨에서 차단하여 복수의 에러신호들을 발생하는 제1스위칭부와, 쿼드러쳐 클록신호들 각각에 응답하여 대응하는 클록신호의 제1레벨에서 상기 복수의 기준검출신호들 중 대응하는 기준신호를 선택하고 제2레벨에서 차단하여 복수의 기준신호들을 발생하는 제2스위칭부를 포함한다. 따라서, 단위동작시간보다 긴 폭을 가진 에러신호와 기준신호를 생성함으로써 보다 고속 동작이 가능하다.
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公开(公告)号：KR100570632B1
公开(公告)日：2006-04-12
申请号：KR1020040052171
申请日：2004-07-06
Applicant: 삼성전자주식회사
IPC: H04L7/02
CPC classification number: H04L7/0338 , H03L7/0812 , H04L7/0025
Abstract: 본 발명은 클록복원회로를 개시한다. 본 발명의 회로는 주파수 체배기, 위상보간기, 위상제어기를 포함한다. 주파수체배기는 서로 동일한 제1주파수를 가지며 서로 위상이 다른 복수의 외부클록신호들을 입력하여 제1주파수보다 높고 서로 동일한 제2주파수를 가지며, 서로 위상이 다른 복수의 내부클록신호들을 발생한다. 위상보간기는 내부클록신호들 중 적어도 2개 이상으로부터 보간에 의해 선택된 위상과 내부클록신호들과 동일 주파수를 가진 회복된 클록신호를 발생한다. 위상제어기는 선택된 위상이 입력데이터의 위상보다 늦어진 경우에는 선택된 위상이 나아가도록 하고, 선택된 위상이 입력데이터의 위상보다 빠른 경우에는 선택된 위상이 지체되도록 위상보간기의 선택된 위상을 변화시킨다. 따라서, 본 발명은 외부클록신호의 주파수를 낮춤으로서 로우 지터, 칩면적감소, 전력소모 절감 등을 달성할 수 있다.
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公开(公告)号：KR1020060003386A
公开(公告)日：2006-01-11
申请号：KR1020040052171
申请日：2004-07-06
Applicant: 삼성전자주식회사
IPC: H04L7/02
CPC classification number: H04L7/0338 , H03L7/0812 , H04L7/0025
Abstract: 본 발명은 클록복원회로를 개시한다. 본 발명의 회로는 주파수 체배기, 위상보간기, 위상제어기를 포함한다. 주파수체배기는 서로 동일한 제1주파수를 가지며 서로 위상이 다른 복수의 외부클록신호들을 입력하여 제1주파수보다 높고 서로 동일한 제2주파수를 가지며, 서로 위상이 다른 복수의 내부클록신호들을 발생한다. 위상보간기는 내부클록신호들 중 적어도 2개 이상으로부터 보간에 의해 선택된 위상과 내부클록신호들과 동일 주파수를 가진 회복된 클록신호를 발생한다. 위상제어기는 선택된 위상이 입력데이터의 위상보다 늦어진 경우에는 선택된 위상이 나아가도록 하고, 선택된 위상이 입력데이터의 위상보다 빠른 경우에는 선택된 위상이 지체되도록 위상보간기의 선택된 위상을 변화시킨다. 따라서, 본 발명은 외부클록신호의 주파수를 낮춤으로서 로우 지터, 칩면적감소, 전력소모 절감 등을 달성할 수 있다.
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