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公开(公告)号：KR101195944B1
公开(公告)日：2012-10-29
申请号：KR1020080128732
申请日：2008-12-17
Applicant: 한국전자통신연구원 , 고려대학교 산학협력단
CPC classification number: H04W36/0011 , H04W36/14
Abstract: 본 발명은 무선 통신 시스템의 심층 패킷 검사 방법 및 그 장치에 관한 것이다. 본 발명에 따른 무선 통신 시스템의 심층 패킷 검사 방법은 핸드오버 발생 시, 핸드오버 전의 제1 서브넷으로부터 단말의 패킷에 대한 제1 심층 패킷 검사 결과를 수신하는 단계, 핸드오버 후의 제2 서브넷으로부터 상기 단말의 패킷에 대한 제2 심층 패킷 검사 결과를 수신하는 단계, 그리고 핸드오버 발생 시 상기 제1 심층 패킷 검사 결과 및 상기 제2 심층 패킷 검사 결과를 재정렬하는 단계를 포함한다.
Deep Packet Inspection, handover, pattern matching-
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公开(公告)号：KR1019940005330B1
公开(公告)日：1994-06-16
申请号：KR1019910026044
申请日：1991-12-30
IPC: H03K3/00
Abstract: The digital pulse generator for generating a random series includes a 2N counter for counting an input clock by 2N, a comparator for comparing the output of the 2N counter with binary data, a counter reset controller for initializing the 2N counter, and a pulse generator connected to the comparator for generating a clock pulse, thereby greatly improving operation speed.
Abstract translation: 用于产生随机序列的数字脉冲发生器包括用于对输入时钟进行2N计数的2N计数器，用于将2N计数器的输出与二进制数据进行比较的比较器，用于初始化2N计数器的计数器复位控制器和连接的脉冲发生器 到比较器产生时钟脉冲，从而大大提高操作速度。
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公开(公告)号：KR101342607B1
公开(公告)日：2013-12-17
申请号：KR1020120014844
申请日：2012-02-14
Abstract: [과제] 블럭의이름/아이콘을화면상에그래픽으로배치하기만하면, 그블럭의레이아웃과, 기능을실행할 I/O인터페이스가나타나며, 블럭들의입력인터페이스들간에그래픽으로연결되면, 그상응되는실제데이터의입출력이이루어지도록데이터의수수처리를행한다. [해결수단] 유저인터페이스를이용한컴퓨터프로그램의워크플로자동구현방법은, 상기컴퓨터프로그램모듈인블럭이, 화면에나타날그래픽형상인과함께, 기능을실행할 1 이상의함수와, 그함수의입력요소가가시화된 1 이상의입력인터페이스와, 그함수의출력요소가가시화된 1 이상의출력인터페이스로이루어지는를포함하도록구성되는와, 선택된상기블럭에대하여, 상기레이아웃이화면의에나타나는와, 선택된상기블럭에대하여, 상기 I/O인터페이스가화면의에나타나는와, 상기링크에디터창내의 2 이상의 I/O인터페이스에대하여, 어느 I/O인터페이스의출력인터페이스가다른 I/O인터페이스의입력인터페이스와그래픽으로링크될수 있도록기능이제공되는와, 상기링크된그래픽정보에대응되는실제블럭의입력요소및 출력요소의데이터전달관계가백그라운드에서기억되는가구비됨을특징으로한다.
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Patent Agency Ranking
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公开(公告)号：KR1019950006319B1
公开(公告)日：1995-06-13
申请号：KR1019920024209
申请日：1992-12-14
IPC: H04L9/12
Abstract: The apparatus corrects the error on the channel employing the majority law according to the ID information presence or not. The apparatus comprises: a first logic or gate(6) processing change control signal(CHGI); a second logic AND gate(7) taking logic summation with the key changing signal; a third multiplexor(1-2) taking the key input; a fourth shift register(5) outputting the scrambled ID information.
Abstract translation: 该装置根据ID信息存在来修正采用多数定律的信道上的错误。 该装置包括：第一逻辑或门（6）处理改变控制信号（CHGI）; 与所述键改变信号进行逻辑求和的第二逻辑与门（7）; 采用密钥输入的第三多路复用器（1-2） 输出加密的ID信息的第四移位寄存器（5）。
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公开(公告)号：KR1019940005777B1
公开(公告)日：1994-06-23
申请号：KR1019910025367
申请日：1991-12-30
Applicant: 한국전자통신연구원
IPC: G06F12/08
Abstract: The circuit for varying a cache directory using first-in first-out (FIFO) includes a program device for generating combination signals, a FIFO for storing a bus address, first and second AND gates, and a flip-flop synchronized with a clock signal, thereby simplifying a circuit construction.
Abstract translation: 用于使用先进先出（FIFO）改变高速缓存目录的电路包括用于产生组合信号的程序设备，用于存储总线地址的FIFO，第一和第二与门以及与时钟信号同步的触发器 ，从而简化电路结构。
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公开(公告)号：KR1019930015496A
公开(公告)日：1993-07-24
申请号：KR1019910026044
申请日：1991-12-30
IPC: H03K3/00
Abstract: 본 발명은 랜덤수열 생성을 위한 디지틀 펄스 발생기에 관한 것으로서, 입력 클럭을 입력받아 2
N 계수수단(1)과, 입력되는 이진 데이타(A0,A1,A2,A3,A4,A5)를 입력으로 받고, 상기 2
N 계수수단(1)에 연결되어 계수출력을 또다른 입력으로 받아 비교하여 동일한 경우에 펄스를 출력하는 비교수단(2)과, 상기 비교수다(2)에 연결되어 상기 비교수다(2)의 출력을 입력으로 받아 상기 2
N 계수수단(1)으로 초기화 신호를 출력하여 상기 2
N 입력 계수수단(1)을 초기화 시키는 계수기 리셋제어 수단(3), 및 상기 비교수단(3)에 연결되어 입력 데이타와 2
N 계수값의 비교출력에 따른 클럭펄스를 출력하는 펄스생성 수단(4)을 구비한 것을 특징으로 하는 디지틀 펄스 발생기.-
公开(公告)号：KR1019980045947A
公开(公告)日：1998-09-15
申请号：KR1019960064199
申请日：1996-12-11
Applicant: 한국전자통신연구원
IPC: G06F15/16
Abstract: 본 발명은 바인딩 핸들 캐쉬를 이용한 원격 프로시쥬어 호출 시스템에 관한 것으로서, 원격 프로시쥬어 호출을 하기 위하여 클라이언트는 이름 서비스 등과 같은 방법을 통하여 서버와 원격 프로시쥬어 호출 연결을 한다. 원격 프로시쥬어 호출을 하기 위하여 클라이언트가 시도하는 서버와 원격 프로시쥬어 호출 연결은 원격 프로시쥬어 호출 성능에 대한 오버헤드로 작용할 뿐만 아니라 통신 비용이 높다. 특히 클라이언트가 여러 사이트에 있는 서버와 원격 프로시쥬어 호출이 빈번한 경우에 원격 프로시쥬어 호출시 클라이언트가 서버들과 이름 서비스 등과 같은 방법에 의존하는 원격 프로시쥬어 호출 연결을 시도하지 않고 직접 원격 프로시쥬어 호출을 할 수 있도록 메모리상의 바인딩 핸들 캐쉬에 바인딩 핸들을 항상 서버와 연결 가능한 상태로 관리하는 바인딩 핸들 캐쉬 관리기이다.
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