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    Method for delaying acknowledgement of operation until operation completion confirmed by local adapter read operation
    1.
    发明专利
    Method for delaying acknowledgement of operation until operation completion confirmed by local adapter read operation 有权
    延迟操作确认的方法本地适配器读取操作确认的完成操作完成

    公开(公告)号：JP2012048712A

    公开(公告)日：2012-03-08

    申请号：JP2011169787

    申请日：2011-08-03

    Applicant: Internatl Business Mach Corp ,  インターナショナル・ビジネス・マシーンズ・コーポレーションInternational Business Maschines Corporation

    Inventor： CRADDOCK DAVID ,  GREGG THOMAS A

    IPC: G06F13/28 ,  G06F13/36

    CPC classification number: G06F13/28

    Abstract: PROBLEM TO BE SOLVED: To provide a computer program product, a computer system and a method, capable of facilitating processing in a computer environment.SOLUTION: A request to perform an operation, such as a remote direct memory access (RDMA) write operation or a send operation that writes to memory, is sent from a sending input/output (I/O) adapter (e.g., an RDMA-capable adapter) to a receiving I/O adapter. The receiving I/O adapter receives the request and initiates performance of the operation, but delays sending an acknowledgement for the operation. The acknowledgement is delayed until the operation is completed (i.e., until the memory is updated and the data are visible to the remote processor), as determined by a read operation initiated and performed by the receiving I/O adapter transparent to the sending I/O adapter.

    Abstract translation: 要解决的问题：提供能够促进计算机环境中的处理的计算机程序产品，计算机系统和方法。 解决方案：从发送输入/输出（I / O）适配器发送执行诸如远程直接存储器访问（RDMA）写入操作或写入存储器的发送操作之类的操作的请求（例如， 支持RDMA的适配器）连接到接收I / O适配器。 接收I / O适配器接收请求并发起操作的性能，但延迟发送操作的确认。 确认被延迟，直到操作完成（即直到存储器被更新并且数据对于远程处理器是可见的），如由发送I / O适配器发起和执行的读取操作所确定的，对于发送I / O适配器。 版权所有（C）2012，JPO＆INPIT

    Infiniband communication link management method, receiver, transmitter and computer program
    2.
    发明专利
    Infiniband communication link management method, receiver, transmitter and computer program 有权
    INFINIBAND通信链路管理方法，接收机，发射机和计算机程序

    公开(公告)号：JP2008172795A

    公开(公告)日：2008-07-24

    申请号：JP2008002431

    申请日：2008-01-09

    Applicant: Internatl Business Mach Corp ,  インターナショナル・ビジネス・マシーンズ・コーポレーションInternational Business Maschines Corporation

    Inventor： GREGG THOMAS A ,  CRADDOCK DAVID

    IPC: H04L12/56

    CPC classification number: H04L47/10 ,  H04L47/11 ,  H04L47/263 ,  Y02D50/10

    Abstract: PROBLEM TO BE SOLVED: To extend transmission distances between a transmitter and a receiver by disabling an InfiniBand-defined credit based flow control. SOLUTION: An InfiniBand-defined credit based flow control suffers from round trip time lag that slows transmission rates. The InfiniBand credit based flow control is disabled to extend transmission distances between a transmitter and a receiver by solving the defect. Disabling InfiniBand credit based flow control enables back to back data packet transmission because credit counts are ignored. Nonetheless, packets can be lost due to overruns in a receive buffer, therefore, packet drop detection mechanisms are employed so that the InfiniBand receiver can send requests to the InfiniBand transmitter to temporarily slow its InfiniBand transmission rate of the data packets. COPYRIGHT: (C)2008,JPO&INPIT

    Abstract translation: 要解决的问题：通过禁用InfiniBand定义的基于信用的流量控制来扩展发射机和接收机之间的传输距离。 解决方案：基于InfiniBand定义的基于信用的流量控制受到往返延迟的影响，导致传输速率降低。 基于InfiniBand信用流量控制被禁用，通过解决缺陷来扩展发射机和接收机之间的传输距离。 禁用InfiniBand信用流量控制可以背靠背数据包传输，因为信用计数被忽略。 然而，由于接收缓冲器中的超载，分组可能丢失，因此采用分组丢弃检测机制，使得InfiniBand接收机可以向InfiniBand发送器发送请求以暂时降低其InfiniBand传输速率的数据分组。 版权所有（C）2008，JPO＆INPIT

    Adaptadores de habilitación/deshabilitación de un entorno de ordenadores
    6.
    发明专利
    Adaptadores de habilitación/deshabilitación de un entorno de ordenadores 未知

    公开(公告)号：ES2452871T3

    公开(公告)日：2014-04-03

    申请号：ES10779302

    申请日：2010-11-08

    Applicant: IBM

    Inventor： GREINER DAN ,  GAINEY CHARLES ,  CRADDOCK DAVID ,  CONESKI ANTHONY ,  GLENDENING BETH ,  FARRELL MARK ,  GREGG THOMAS ,  NJOKU-CHARLES UGOCHUKWU

    IPC: G06F13/28 ,  G06F13/38

    Abstract: Un método para habilitar adaptadores en un entorno de ordenadores, que comprende las etapas de: responder para ejecutar una instrucción de Procesador Lógico de Llamada CLP (400) expedida por un sistema operativo para habilitar un adaptador seleccionado por el sistema operativo, comprendiendo la instrucción CLP un identificador de función (426) que identifica el adaptador y que tiene 5 un indicador de adaptador no habilitado (352), solicitando la instrucción CLP un número de espacios de direcciones de acceso directo a memoria DMA (430) para ser asignados al adaptador, habilitando la ejecución uno o más espacios de dirección DMA y que comprende: a) habilitar el adaptador, en donde la habilitación comprende habilitar el registro para la traducción e interrupción de dirección para el soporte de accesos de memoria directos e interrupciones señalizadas con mensaje para el adaptador, y en donde la habilitación comprende determinar (512) que el número de de espacios de dirección DMA solicitados está disponible comprobando que hay entradas de tabla de dispositivo para el número de espacios de dirección DMA solicitado, y asignar (542) un número de entradas de tabla de dispositivo, correspondiente al número de espacios de dirección de DMA solicitado, al adaptador; y b) devolver (550) el identificador de función que tiene un indicador de adaptador habilitado.

    STORE/STORE BLOCK INSTRUCTIONS FOR COMMUNICATING WITH ADAPTERS
    9.
    发明专利
    STORE/STORE BLOCK INSTRUCTIONS FOR COMMUNICATING WITH ADAPTERS 未知

    公开(公告)号：ZA201209562B

    公开(公告)日：2013-08-28

    申请号：ZA201209562

    申请日：2012-12-14

    Applicant: IBM

    Inventor： GREINER DAN ,  GREGG THOMAS ,  CRADDOCK DAVID ,  FARRELL MARK

    IPC: G06F20060101

    Abstract: Communication with adapters of a computing environment is facilitated. Control instructions specifically designed for communicating data to and from adapters are provided to facilitate the communication. The instructions explicitly target the adapters. Information provided in an instruction is used to steer the instruction to an appropriate location within the adapter, such as a Peripheral Component Interconnect (PCI) or Peripheral Component Interconnect Express (PCIe) adapter.

    TADUCCION DE DIRECCIONES DE NETRADA/SALIDA A DIRECCIONES DE MEMORIA.
    10.
    发明专利
    TADUCCION DE DIRECCIONES DE NETRADA/SALIDA A DIRECCIONES DE MEMORIA. 未知

    公开(公告)号：MX2012014859A

    公开(公告)日：2013-02-01

    申请号：MX2012014859

    申请日：2010-11-08

    Applicant: IBM

    Inventor： GREINER DAN ,  CRADDOCK DAVID ,  GREGG THOMAS ,  LAIS ERIC NORMAN

    IPC: G06F13/16 ,  G06F12/10

    Abstract: Una dirección que se proporciona en una solicitud enviada por un adaptador, se convierte en una dirección utilizable directamente para acceso a memoria del sistema. La dirección incluye una pluralidad de bits, en donde la pluralidad de bits incluye una primer porción de bits y una segunda porción de bits. La segunda porción de bits se emplea para indexar el uno o más niveles de tablas de traducción de dirección para realizar la conversión, mientras que la primera porción de bits se ignora para la conversión. La primera porción de bits se emplea para validar la dirección.

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