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11.发明专利
公开(公告)号：DE112020000930T5
公开(公告)日：2021-12-16
申请号：DE112020000930
申请日：2020-02-14
Applicant: IBM
Inventor： SLEGEL TIMOTHY , TZORTZATOS ELPIDA
Abstract: Ausgeführt wird eine einzelne architekturgebundene Anweisung zum Ausführen mehrerer Funktionen. Das Ausführen umfasst ein Ausführen einer ersten Funktion von den mehreren Funktionen und einer zweiten Funktion von den mehreren Funktionen. Die erste Funktion umfasst ein Verschieben eines Datenblocks von einem Speicherort zu einem anderen Speicherort, und die zweite Funktion umfasst ein Festlegen eines Abschnitts eines Speicherschlüssels unter Verwendung eines ausgewählten Schlüssels, und eines weiteren Abschnitts des Speicherschlüssels unter Verwendung eines weiteren ausgewählten Schlüssels. Der Speicherschlüssel ist dem Datenblock zugehörig und kontrolliert den Zugriff auf den Datenblock. Die erste Funktion und die zweite Funktion werden als Teil der einzelnen architekturgebundenen Anweisung ausgeführt.
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公开(公告)号：AU2012265964B2
公开(公告)日：2015-08-20
申请号：AU2012265964
申请日：2012-05-22
Applicant: IBM
Inventor： GAINEY JR CHARLES , OAKES KENNETH JAMES , MATHIAS THOMAS BRIAN , SZWED PETER KENNETH , DRIEVER PETER DANA , SUTTON PETER GRIMM , YUDENFRIEND HARRY , TZORTZATOS ELPIDA , GLASSEN STEVEN GARDNER
IPC: G06F13/00
Abstract: An abstraction for storage class memory is provided that hides the details of the implementation of storage class memory from a program, and provides a standard channel programming interface for performing certain actions, such as controlling movement of data between main storage and storage class memory or managing storage class memory.
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公开(公告)号：CA3217151A1
公开(公告)日：2022-12-08
申请号：CA3217151
申请日：2022-05-31
Applicant: IBM
Inventor： GIAMEI BRUCE , SLEGEL TIMOTHY , BORNTRAEGER CHRISTIAN , OSISEK DAMIAN , HELLER LISA , GAERTNER UTE , YOST CHRISTINE , TZORTZATOS ELPIDA
IPC: G06F12/1009 , G06F12/1027
Abstract: An instruction is provided to perform a reset address translation protection operation when executed. Executing the instruction includes determining, by a processor, that an address translation protection bit in a specified translation table entry associated with a storage block is to be reset. Based on determining that the address translation protection bit is to be reset, executing the instruction includes resetting the address translation protection bit to deactivate write protection for the storage block. The resetting is absent waiting for an action by one or more other processors of the computing environment.
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公开(公告)号：CA2819213C
公开(公告)日：2020-04-28
申请号：CA2819213
申请日：2012-05-22
Applicant: IBM
Inventor： GAINEY CHARLES , OAKES KENNETH JAMES , MATHIAS THOMAS BRIAN , SZWED PETER KENNETH , DRIEVER PETER DANA , SUTTON PETER GRIMM , YUDENFRIEND HARRY , TZORTZATOS ELPIDA , GLASSEN STEVEN GARDNER
IPC: G06F13/00
Abstract: An abstraction for storage class memory is provided that hides the details of the implementation of storage class memory from a program, and provides a standard channel programming interface for performing certain actions, such as controlling movement of data between main storage and storage class memory or managing storage class memory.
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公开(公告)号：GB2506073B
公开(公告)日：2015-04-08
申请号：GB201400048
申请日：2012-05-25
Applicant: IBM
Inventor： GAINEY CHARLES JR , OAKES KENNETH JAMES , MATHIAS THOMAS BRIAN , SZWED PETER KENNETH , DRIEVER PETER DANA , SUTTON PETER GRIMM , YUDENFRIEND HARRY , TZORTZATOS ELPIDA , GLASSEN STEVEN GARDNER
IPC: G06F13/38
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Patent Agency Ranking
公开(公告)号：BR112023021648A2
公开(公告)日：2023-12-26
申请号：BR112023021648
申请日：2022-05-31
Applicant: IBM
Inventor： GIAMEI BRUCE , BORNTRAEGER CHRISTIAN , YOST CHRISTINE , OSISEK DAMIAN , TZORTZATOS ELPIDA , HELLER LISA , SLEGEL TIMOTHY , GAERTNER UTE
IPC: G06F12/14 , G06F12/1009 , G06F12/1027
Abstract: instrução de redefinição de proteção de tradução de endereço dinâmico. uma instrução é fornecida para executar uma operação de redefinição de proteção de tradução de endereço quando executada. a execução da instrução inclui determinar, por um processador, que um bit de proteção de tradução de endereço em uma entrada de tabela de tradução especificada associada a um bloco de armazenamento deve ser redefinido. com base na determinação de que o bit de proteção de tradução de endereço deve ser redefinido, a execução da instrução inclui a redefinição do bit de proteção de tradução de endereço para desativar a proteção contra gravação para o bloco de armazenamento. a redefinição está ausente, aguardando uma ação de um ou mais outros processadores do ambiente de computação.
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公开(公告)号：DE112018004636T5
公开(公告)日：2020-07-16
申请号：DE112018004636
申请日：2018-11-08
Applicant: IBM
Inventor： MATSAKIS NICHOLAS , WALTERS CRAIG , BARTIK JANE , SHUM CHUNG-LUNG , TZORTZATOS ELPIDA
Abstract: Eine gemeinsam genutzten Cachezeile wird von mehreren Prozessoren einer Datenverarbeitungsumgebung gleichzeitig geändert. Die gleichzeitige Änderung wird mindestens beruhend darauf durchgeführt, dass eine oder mehrere architekturdefinierte Anweisungen („Fetch due to Non-Coherent Store“-Anweisungen) empfangen werden, die es mehreren Prozessoren gestatten, die gemeinsam genutzte Cachezeile gleichzeitig zu aktualisieren, ohne eine Sperre zu erhalten oder über eine exklusive Eigentümerschaft der Daten zu verfügen.
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公开(公告)号：SI2601580T1
公开(公告)日：2016-02-29
申请号：SI201230431
申请日：2012-05-25
Applicant: IBM
Inventor： GAINEY JR CHARLES , OAKES KENNETH JAMES , MATHIAS THOMAS BRIAN , SZWED PETER KENNETH , DRIEVER PETER DANA , SUTTON PETER GRIMM , YUDENFRIEND HARRY , TZORTZATOS ELPIDA , GLASSEN STEVEN GARDNER
IPC: G06F9/00
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公开(公告)号：PT2601582E
公开(公告)日：2014-10-20
申请号：PT12796711
申请日：2012-05-22
Applicant: IBM
Inventor： SZWED PETER KENNETH , SUTTON PETER GRIMM , DRIEVER PETER DANA , YUDENFRIEND HARRY , GLASSEN STEVEN GARDNER , GAINEY CHARLES , OAKES KENNETH JAMES , MATHIAS THOMAS BRIAN , TZORTZATOS ELPIDA
IPC: G06F12/08
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公开(公告)号：ZA201302031B
公开(公告)日：2014-08-27
申请号：ZA201302031
申请日：2013-03-18
Applicant: IBM
Inventor： GAINEY JR CHARLES , MATHIAS THOMAS BRIAN , DRIEVER PETER DANA , YUDENFRIEND HARRY , GLASSEN STEVEN GARDNER , OAKES KENNETH JAMES , SZWED PETER KENNETH , SUTTON PETER GRIMM , TZORTZATOS ELPIDA
IPC: G06F20060101
Abstract: An abstraction for storage class memory is provided that hides the details of the implementation of storage class memory from a program, and provides a standard channel programming interface for performing certain actions, such as controlling movement of data between main storage and storage class memory or managing storage class memory.
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