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    APPARATUS AND METHOD FOR MULTI-LEVEL CACHE UTILIZATION
    1.
    发明申请
    APPARATUS AND METHOD FOR MULTI-LEVEL CACHE UTILIZATION 审中-公开
    多级高速缓存应用的设备和方法

    公开(公告)号：WO2010002647A3

    公开(公告)日：2010-03-25

    申请号：PCT/US2009048386

    申请日：2009-06-24

    Applicant: INTEL CORP ,  TETRICK R SCOTT ,  JUENEMANN DALE ,  BRENNAN ROBERT

    Inventor： TETRICK R SCOTT ,  JUENEMANN DALE ,  BRENNAN ROBERT

    IPC: G06F13/14 ,  G06F3/06 ,  G06F12/00

    CPC classification number: G06F12/0897 ,  G06F12/0866 ,  G06F2212/222 ,  G11C2211/5641

    Abstract: In some embodiments, a non-volatile cache memory may include a multi-level non-volatile cache memory configured to be located between a system memory and a mass storage device of an electronic system and a controller coupled to the multi-level non-volatile cache memory, wherein the controller is configured to control utilization of the multi-level non-volatile cache memory. Other embodiments are disclosed and claimed.

    Abstract translation: 在一些实施例中，非易失性高速缓冲存储器可以包括被配置为位于电子系统的系统存储器和大容量存储设备之间的多级非易失性高速缓存存储器，以及耦合到多级非易失性存储器 缓存存储器，其中所述控制器被配置为控制所述多级非易失性高速缓冲存储器的利用。 公开和要求保护其他实施例。

    4.
    发明专利
    未知

    公开(公告)号：DE112007001987T5

    公开(公告)日：2010-01-07

    申请号：DE112007001987

    申请日：2007-09-25

    Applicant: INTEL CORP

    Inventor： JUENEMANN DALE ,  DIEFENBAUGH PAUL

    IPC: G06F1/32 ,  G06F1/26

    Abstract: A method which includes initiating a power management policy based on a processing element for a computing platform entering a given power state. The power management policy includes a determination as to whether an input/output (I/O) controller and a memory controller for the computing platform are substantially quiescent. The computing platform may then be transitioned to a low power system state from a run power system state based on a determination that both the I/O controller and the memory controller are substantially quiescent and an indication that the computing platform is capable of entering the low power system state. According to this method, the low power system state includes entering one or more devices responsive to the computing platform in a power level adequate to retain a configuration state that enables the one or more devices to transition back to the run power system state in a manner that is substantially transparent to an operating system for the computing platform. Other implementations and examples are also described in this disclosure.

    VERBESSERTES SPEICHERUNGSMODELL FÜR EIN COMPUTERSYSTEM MIT PERSISTENTEM SYSTEMSPEICHER
    7.
    发明专利
    VERBESSERTES SPEICHERUNGSMODELL FÜR EIN COMPUTERSYSTEM MIT PERSISTENTEM SYSTEMSPEICHER 未知

    公开(公告)号：DE102019112291A1

    公开(公告)日：2019-12-12

    申请号：DE102019112291

    申请日：2019-05-10

    Applicant: INTEL CORP

    Inventor： JUENEMANN DALE ,  BOYD JAMES

    IPC: G06F9/00

    Abstract: Es wird ein Prozessor beschrieben. Der Prozessor umfasst Registerplatz zum Annehmen von Eingangsparametern eines Softwarebefehls zum Verlagern eines Datenpostens aus Computer-Systemspeicherung heraus und in persistenten Systemspeicher. Die Eingangsparameter umfassen eine Kennung eines Softwareprozesses, der Zugriff auf den Datenposten im persistenten Systemspeicher wünscht, und eine virtuelle Adresse des Datenpostens, auf die sich der Softwareprozess bezieht.

    Überführen einer Rechenplattform in einen Systemzustand niedriger Leistung
    8.
    发明专利
    Überführen einer Rechenplattform in einen Systemzustand niedriger Leistung 未知

    公开(公告)号：DE112007001987B4

    公开(公告)日：2013-05-16

    申请号：DE112007001987

    申请日：2007-09-25

    Applicant: INTEL CORP

    Inventor： JUENEMANN DALE ,  DIEFENBAUGH PAUL

    IPC: G06F1/32 ,  G06F1/26

    Abstract: Verfahren zum Überführen einer Rechnerplattform in einen Zustand niedriger Leistung, das aufweist: Einleiten einer Energieverwaltungsstrategie basierend auf einem Verarbeitungselement für eine Rechenplattform, das in einen Niedrigkomponentenleistungszustand eintritt, wobei die Energieverwaltungsstrategie umfasst: Feststellen, ob ein Eingabe/Ausgabe(I/O – Input/Output)-Controller und ein Speichercontroller für die Rechenplattform im Wesentlichen untätig sind, und ob eine Zeit, die seit dem Eintreten des Verarbeitungselements in den Niedrigkomponentenleistungszustand vergangen ist, einer bestimmten Zeitschwelle entspricht; und Überführen der Rechenplattform aus einem Systemzustand der Betriebsleistung in einen Standby-Systemzustand basierend auf einer Feststellung, dass sowohl der I/O-Controller als auch der Speichercontroller im Wesentlichen untätig sind, dass die Zeit, die seit dem Eintreten des Verarbeitungselements in den Niedrigkomponentenleistungszustand vergangen ist, der Schwelle entspricht, und einer Angabe, dass die Rechenplattform in der Lage ist, in den Standby-Systemzustand einzutreten, wobei der Standby-Systemzustand das Einstellen einer oder mehrerer Baugruppen, ansprechend auf die Rechenplattform, in einen niedrigen Leistungspegel umfasst, wobei der niedrige Leistungspegel...

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