PROCEDE DE DEPOT PAR EPITAXIE EN PHASE GAZEUSE

    公开(公告)号:FR3057102A1

    公开(公告)日:2018-04-06

    申请号:FR1659611

    申请日:2016-10-05

    Abstract: L'invention concerne un Procédé de dépôt par épitaxie en phase gazeuse de silicium, de germanium ou de silicium-germanium sur une surface (35) semiconductrice monocristalline d'un substrat, ce procédé comprenant des étapes successives suivantes : disposer le substrat dans un réacteur d'épitaxie balayé par un gaz porteur ; porter la température du substrat à une première valeur ; introduire, pendant une première durée, au moins un premier gaz précurseur du silicium et/ou un gaz précurseur du germanium ; et réduire la température du substrat à une deuxième valeur, le procédé comprenant, à la fin de la première durée, le maintien de 1'introduction du premier gaz précurseur du silicium et/ou l'introduction d'un deuxième gaz précurseur du silicium, lesdits gaz ayant une pression partielle adaptée à former une couche de silicium ayant une épaisseur inférieure à 0, 5 nm.

    POINT MEMOIRE A MATERIAU A CHANGEMENT DE PHASE

    公开(公告)号:FR3073075B1

    公开(公告)日:2020-09-04

    申请号:FR1760166

    申请日:2017-10-27

    Abstract: L'invention concerne un point mémoire à matériau à changement de phase, comprenant, sur un via (108) de liaison avec un transistor, un élément de chauffage (116) du matériau à changement de phase (118), et, entre le via et l'élément de chauffage (116), une couche (202) en un matériau électriquement isolant ou de résistivité électrique supérieure à 2,5·10-5 Ω.m, les interfaces entre ladite couche et les matériaux en contact avec les deux faces de ladite couche formant une barrière thermique, ladite couche étant suffisamment mince pour pouvoir être traversée par un courant électrique par un effet de type effet tunnel.

    Capteur optique intégré à photodiodes pincées

    公开(公告)号:FR3111019A1

    公开(公告)日:2021-12-03

    申请号:FR2005537

    申请日:2020-05-26

    Inventor: DUTARTRE DIDIER

    Abstract: Capteur optique intégré, comprenant au moins un module de détection (MD) comportant une photodiode pincée (PPD) comportant au sein d’un substrat semiconducteur, une première région semiconductrice (RG1) ayant un premier type de conductivité située entre une deuxième région semiconductrice (RG2) ayant un deuxième type de conductivité opposé au premier et une troisième région semiconductrice (RG3) ayant le deuxième type de conductivité, plus épaisse, moins dopée et située plus en profondeur dans le substrat que la deuxième région (RG2), et comportant du silicium et du germanium présentant au moins un premier gradient de concentration (GR1 ; GR10). Figure pour l’abrégé : Fig 1

    Procédé de fabrication de puces semiconductrices

    公开(公告)号:FR3122524B1

    公开(公告)日:2025-02-21

    申请号:FR2104505

    申请日:2021-04-29

    Abstract: Procédé de fabrication de puces semiconductrices La présente description concerne un procédé de fabrication d'une puce semiconductrice, comportant les étapes suivantes : a) prévoir un substrat (101) en silicium monocristallin dopé ;b) former par épitaxie, sur et en contact avec la face supérieure du substrat (101), une couche (103) en silicium monocristallin dopé ; c) avant ou après l'étape b), et avant toute autre étape de traitement thermique à une température comprise entre 600°C et 900°C, appliquer au substrat un traitement thermique de dénudage, à une température supérieure ou égale à 1000°C pendant plusieurs heures. Figure pour l'abrégé : Fig. 2

    Capteur optique intégré à photodiodes pincées

    公开(公告)号:FR3111019B1

    公开(公告)日:2022-07-22

    申请号:FR2005537

    申请日:2020-05-26

    Inventor: DUTARTRE DIDIER

    Abstract: Capteur optique intégré, comprenant au moins un module de détection (MD) comportant une photodiode pincée (PPD) comportant au sein d’un substrat semiconducteur, une première région semiconductrice (RG1) ayant un premier type de conductivité située entre une deuxième région semiconductrice (RG2) ayant un deuxième type de conductivité opposé au premier et une troisième région semiconductrice (RG3) ayant le deuxième type de conductivité, plus épaisse, moins dopée et située plus en profondeur dans le substrat que la deuxième région (RG2), et comportant du silicium et du germanium présentant au moins un premier gradient de concentration (GR1 ; GR10). Figure pour l’abrégé : Fig 1

    Procédé de fabrication de puces semiconductrices

    公开(公告)号:FR3122524A1

    公开(公告)日:2022-11-04

    申请号:FR2104505

    申请日:2021-04-29

    Abstract: Procédé de fabrication de puces semiconductrices La présente description concerne un procédé de fabrication d'une puce semiconductrice, comportant les étapes suivantes : a) prévoir un substrat (101) en silicium monocristallin dopé ;b) former par épitaxie, sur et en contact avec la face supérieure du substrat (101), une couche (103) en silicium monocristallin dopé ; c) avant ou après l'étape b), et avant toute autre étape de traitement thermique à une température comprise entre 600°C et 900°C, appliquer au substrat un traitement thermique de dénudage, à une température supérieure ou égale à 1000°C pendant plusieurs heures. Figure pour l'abrégé : Fig. 2

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