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公开(公告)号：CN1622097A
公开(公告)日：2005-06-01
申请号：CN200410095888.8
申请日：2004-11-26
Applicant: 松下电器产业株式会社
IPC: G06F17/50
CPC classification number: G01R29/26
Abstract: 根据半导体集成电路的设计数据，计算与电源布线相关的一个阻抗，并根据所计算出的阻抗，分析电源噪声的频率特性。在阻抗计算中，可以计算不同电位的电源，例如，主电源和地之间的阻抗。或者，可以计算在电位基本相同的电源，例如，主电源和N阱电源之间的阻抗。所计算出的阻抗包括电源布线之间的布线电容、衬底电阻、连接到所述电源布线的封装阻抗等。因此，能够提供在设计过程的较早阶段用较小的计算量进行地分析半导体集成电路的电源噪声的方法。
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公开(公告)号：CN1574289A
公开(公告)日：2005-02-02
申请号：CN200410079416.3
申请日：2004-06-09
Applicant: 松下电器产业株式会社
IPC: H01L21/82
CPC classification number: G06F17/5022 , G01R31/318357 , G01R31/31928
Abstract: 本发明包括：基于电路信息通过计算电源端的一个半导体集成电路的每个实例的电压波形并且分析每个实例的电压波形，从而形成电压波形信息的步骤，通过抽象电压波形信息来形成电压抽象信息的步骤，以及基于电压抽象信息来计算实例的一个延迟值的步骤。
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公开(公告)号：CN1492497A
公开(公告)日：2004-04-28
申请号：CN03158409.8
申请日：2003-09-09
Applicant: 松下电器产业株式会社
CPC classification number: G06F17/5031 , G06F17/5045
Abstract: 本发明提供一种半导体集成电路的设计方法，可以不减少元件布置所需要的有效面积和电源焊盘以外所使用的焊盘数量，而且不增加处理时间，就能减少IR下降对时序的影响和IR下降自身，可以进行近似实际工作的时序仿真。在触发器驱动能力改变步骤，将任意触发器置换成所具有的延迟时间比从因电源布线的电阻成分引起电源电压产生压降的状态转变至理想电源的状态的时间长的触发器。由此，仅限定触发器来预先制作考虑IR下降的延迟库，可以减少库制作时间，且提高延迟计算步骤的延迟时间计算精度，进一步通过置换成驱动能力低的触发器，可以减少面积。
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公开(公告)号：CN100359516C
公开(公告)日：2008-01-02
申请号：CN200410071218.2
申请日：2004-07-16
Applicant: 松下电器产业株式会社
CPC classification number: G06F17/5036
Abstract: 一种考虑了半导体集成电路的延时计算对象网的邻近网的延时计算方法，包含，选择邻近网驱动单元的静态组合的邻近网内部电阻选择工序、把由从上述工序选择了的邻近网驱动单元的内部电阻等求得的系数乘耦合电容，把由此得到的值作为延时计算对象网的耦合电容接地的耦合电容接地工序、从由这些工序得到的电路导出延时值的延时值导出工序。由此，解决实际上由于把电位变动的邻近布线零电位近似而不能求出正确的延时值这样的延时计算方法中的问题。
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公开(公告)号：CN1577340A
公开(公告)日：2005-02-09
申请号：CN200410071218.2
申请日：2004-07-16
Applicant: 松下电器产业株式会社
CPC classification number: G06F17/5036
Abstract: 一种考虑了半导体集成电路的延时计算对象网的邻近网的延时计算方法，包含，选择邻近网驱动单元的静态组合的邻近网内部电阻选择工序、把由从上述工序选择了的邻近网驱动单元的内部电阻等求得的系数乘耦合电容，把由此得到的值作为延时计算对象网的耦合电容接地的耦合电容接地工序、从由这些工序得到的电路导出延时值的延时值导出工序。由此，解决实际上由于把电位变动的邻近布线零电位近似而不能求出正确的延时值这样的延时计算方法中的问题。
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Patent Agency Ranking
公开(公告)号：CN100367286C
公开(公告)日：2008-02-06
申请号：CN200410095888.8
申请日：2004-11-26
Applicant: 松下电器产业株式会社
IPC: G06F17/50
CPC classification number: G01R29/26
Abstract: 根据半导体集成电路的设计数据，计算与电源布线相关的一个阻抗，并根据所计算出的阻抗，分析电源噪声的频率特性。在阻抗计算中，可以计算不同电位的电源，例如，主电源和地之间的阻抗。或者，可以计算在电位基本相同的电源，例如，主电源和N阱电源之间的阻抗。所计算出的阻抗包括电源布线之间的布线电容、衬底电阻、连接到所述电源布线的封装阻抗等。因此，能够提供在设计过程的较早阶段用较小的计算量进行地分析半导体集成电路的电源噪声的方法。
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公开(公告)号：CN1912881A
公开(公告)日：2007-02-14
申请号：CN200610121543.4
申请日：2004-07-16
Applicant: 松下电器产业株式会社
IPC: G06F17/50
CPC classification number: G06F17/5036
Abstract: 一种考虑了半导体集成电路的延时计算对象网的邻近网的延时计算方法，包含，选择邻近网驱动单元的静态组合的邻近网内部电阻选择工序、把由从上述工序选择了的邻近网驱动单元的内部电阻等求得的系数乘耦合电容，把由此得到的值作为延时计算对象网的耦合电容接地的耦合电容接地工序、从由这些工序得到的电路导出延时值的延时值导出工序。由此，解决实际上由于把电位变动的邻近布线零电位近似而不能求出正确的延时值这样的延时计算方法中的问题。
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公开(公告)号：CN1271705C
公开(公告)日：2006-08-23
申请号：CN03158409.8
申请日：2003-09-09
Applicant: 松下电器产业株式会社
CPC classification number: G06F17/5031 , G06F17/5045
Abstract: 本发明提供一种半导体集成电路的设计方法，可以不减少元件布置所需要的有效面积和电源焊盘以外所使用的焊盘数量，而且不增加处理时间，就能减少IR下降对时序的影响和IR下降自身，可以进行近似实际工作的时序仿真。在触发器驱动能力改变步骤，将任意触发器置换成所具有的延迟时间比从因电源布线的电阻成分引起电源电压产生压降的状态转变至理想电源的状态的时间大的触发器。由此，仅限定触发器来预先制作考虑IR下降的延迟库，可以减少库制作时间，且提高延迟计算步骤的延迟时间计算精度，进一步通过置换成驱动能力低的触发器，可以减少面积。
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公开(公告)号：CN1637745A
公开(公告)日：2005-07-13
申请号：CN200410082184.7
申请日：2004-12-31
Applicant: 松下电器产业株式会社
IPC: G06F17/50
CPC classification number: G06F17/5036 , G06F17/5063
Abstract: 根据一个半导体集成电路的设计数据来计算电源线的阻抗，获得所计算出的阻抗的频率特性，并根据所获得的频率特性来更改所述半导体集成电路的设计。作为上述阻抗，可以计算电势不同的电源例如电源和地之间的阻抗，或者可以计算电势基本相同的电源例如电源和N－阱电源之间的阻抗。通过设计修改，改变了例如布线方法、焊盘数量、电源的隔离、封装类型、电感元件的特性、衬底结构、布线之间的距离、去耦电容、布线的长度和电阻元件的特性。
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公开(公告)号：CN1474448A
公开(公告)日：2004-02-11
申请号：CN03127819.1
申请日：2003-08-11
Applicant: 松下电器产业株式会社
CPC classification number: G06F17/505 , G06F17/5022 , G06F17/5068
Abstract: 本发明提供一种半导体集成电路器件的设计方法，该半导体集成电路器件通过金属布线来连接硅晶片上形成的晶体管的端子间，其特征在于，具有以下步骤：第一步骤，输入有关上述晶体管的信息，进行概略布置以使上述晶体管间连接的布线距离和布线电容最小；第二步骤，根据上述晶体管的概略布置来制作有关压降值的信息；及第三步骤，根据有关上述压降值的信息来进行上述晶体管的布置。
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