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公开(公告)号：FR2916915B1
公开(公告)日：2009-09-04
申请号：FR0755443
申请日：2007-06-04
Applicant: ST MICROELECTRONICS SA , CENTRE NAT RECH SCIENT
Inventor： RIVET FRANCOIS , BELOT DIDIER , DEVAL YANN , BEGUERET JEAN BAPTISTE , LAPUYADE HERVE , TARIS THIERRY
Abstract: A device processes a received radio signal. Circuitry formulates voltage samples of the radio signal. Analog processing of those samples is performed. Then, digital processing is performed on the output of the analog processing. The circuitry for formulating voltage samples is configured to ensure a processing of the samples prior to the digital processing.
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公开(公告)号：FR2926936A1
公开(公告)日：2009-07-31
申请号：FR0850499
申请日：2008-01-28
Applicant: ST MICROELECTRONICS SA , CENTRE NAT RECH SCIENT
Inventor： BELOT DIDIER , DELTIMPLE NATHALIE , KERHERVE ERIC , DEVAL YANN
IPC: H03B5/12
Abstract: L'invention concerne un circuit électronique (44) adapté à fournir un premier signal (S4) oscillant, comprenant un amplificateur de puissance (54) monté en oscillateur. L'amplificateur de puissance (54) est adapté à recevoir un deuxième signal (S15) et à fournir un troisième signal (S16). Le circuit électronique comprend, en outre, un circuit d'adaptation d'impédance (56) adapté à recevoir le troisième signal et à fournir le premier signal (S4) et un circuit de rétroaction (58) adapté à recevoir le premier signal et à fournir le deuxième signal.
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公开(公告)号：FR2875972B1
公开(公告)日：2006-12-15
申请号：FR0410367
申请日：2004-09-30
Applicant: ST MICROELECTRONICS SA
Inventor： OUSTALOUP ALAIN YVES , DEVAL YANN , BELOT DIDIER , MELCHIOR PIERRE , BEGUERET JEAN BAPTISTE , BADETS FRANCK , LAGARESTE VINCENT
Abstract: The synthesizer has a phase locked loop (PLL) with a variable frequency divider (45) converting an output signal from a VCO to a suitable frequency for comparison with a reference in a PFD. A lowpass filter (43) of fractional order feeds a control voltage from a charge pump to the VCO according to the measured phase difference between the divided VCO signal and the reference frequency signal. The lowpass loop filter is preferably made up of a first stage (431) of integer order and a second stage (432) of order between zero and one, especially 0.5.
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公开(公告)号：FR2807595A1
公开(公告)日：2001-10-12
申请号：FR0004501
申请日：2000-04-07
Applicant: ST MICROELECTRONICS SA
Inventor： BEGUERET JEAN BAPTISTE , BELOT DIDIER , DEVAL YANN , FOUILLAT PASCAL , SPATARO ANNE
Abstract: The invention concerns a circuit for generating phase-shifted signals comprising at least two adders (15, 16) each including at least two inputs for receiving identical two-state phase-shifted signals, each input of each adder (15, 16) being assigned a positive or negative single-unit coefficient so that it generates in output of said adders (15, 16) two identical phase-shifted signals.
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公开(公告)号：FR3002392A1
公开(公告)日：2014-08-22
申请号：FR1351308
申请日：2013-02-15
Applicant: ST MICROELECTRONICS SA , CENTRE NAT RECH SCIENT , INST POLYTECHNIQUE BORDEAUX , UNIV BORDEAUX 1
Inventor： BELOT DIDIER , DEVAL YANN , RIVET FRANCOIS
Abstract: L'invention concerne un dispositif de génération d'un signal, comprenant : un transformateur à changement de mode (E1, E2) ; et un circuit (605i, 605i', 609) adapté à sommer, sur une première borne d'accès (N1) du transformateur, des courants représentatifs de signaux reçus sur des premières bornes d'entrée (Si) du dispositif, et sur une seconde borne d'accès (N2) du transformateur, des courants représentatifs de signaux reçus sur des secondes bornes d'entrée (Si') du dispositif.
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Patent Agency Ranking
公开(公告)号：FR2964809B1
公开(公告)日：2012-11-02
申请号：FR1057335
申请日：2010-09-14
Applicant: ST MICROELECTRONICS SA , CENTRE NAT RECH SCIENT
Inventor： BELOT DIDIER , LUCAS DE PESLOUAN PIERRE-OLIVIER , MAJEK CEDRIC , DEVAL YANN , TARIS THIERRY , BEGUERET JEAN-BAPTISTE
IPC: H03L7/18
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公开(公告)号：FR2962272A1
公开(公告)日：2012-01-06
申请号：FR1002739
申请日：2010-06-30
Inventor： REGIMBAL NICOLAS , BADETS FRANCK , DEVAL YANN , BEGUERET JEAN BAPTISTE
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公开(公告)号：FR2916916B1
公开(公告)日：2009-09-04
申请号：FR0755441
申请日：2007-06-04
Applicant: ST MICROELECTRONICS SA , CENTRE NAT RECH SCIENT
Inventor： RIVET FRANCOIS , BELOT DIDIER , DEVAL YANN , BEGUERET JEAN BAPTISTE , DALLET DOMINIQUE
IPC: H04B1/26
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公开(公告)号：DE602006002414D1
公开(公告)日：2008-10-09
申请号：DE602006002414
申请日：2006-04-06
Applicant: ST MICROELECTRONICS SA
Inventor： BADETS FRANCK , BELOT DIDIER , LAGARESTE VINCENT , DEVAL YANN , MELCHIOR PIERRE , BEGUERET JEAN-BAPTISTE
IPC: H03L7/087
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公开(公告)号：FR3002345A1
公开(公告)日：2014-08-22
申请号：FR1351307
申请日：2013-02-15
Applicant: ST MICROELECTRONICS SA , CENTRE NAT RECH SCIENT , INST POLYTECHNIQUE BORDEAUX , UNIV BORDEAUX 1
Inventor： BELOT DIDIER , DEVAL YANN , RIVET FRANCOIS
Abstract: L'invention concerne un procédé de génération d'un signal radiofréquence, dans lequel un signal à émettre est décomposé en une somme pondérée de signaux périodiques de base (Si) de fréquences (fi) distinctes.
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