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公开(公告)号：KR101532363B1
公开(公告)日：2015-06-30
申请号：KR1020090057179
申请日：2009-06-25
Applicant: 삼성전자주식회사
CPC classification number: G06F21/74 , G06F12/1491
Abstract: 본발명의반도체장치의액세스제어방법은, 입력된패스워드를해쉬연산기의입력으로제공하고, 해쉬연산기에서해쉬연산을수행하여제1 해쉬값을출력하고, 제1 해쉬값및 불휘발성메모리에저장된제2 해쉬값이일치하지않을때 상기제1 해쉬값을상기해쉬연산기의입력으로제공하여해쉬연산기에서상기해쉬연산을반복수행하도록제어하고, 그리고제1 및제2 해쉬값들이일치할때 해쉬연산기의해쉬연산의반복횟수에따라서내부회로에대한액세스레벨을설정한다.
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公开(公告)号：KR1020140110142A
公开(公告)日：2014-09-17
申请号：KR1020130022851
申请日：2013-03-04
Applicant: 삼성전자주식회사
IPC: G06F7/58
Abstract: A random number generator according to an embodiment of the present invention comprises: a first oscillator generating a first oscillating signal having a first frequency; a second oscillator generating a second oscillating signal having a second frequency different from the first frequency; a sampling unit receiving the first and second oscillating signals, generating at least one entropy source by combining the inputted first and second oscillating signals, and sampling a bit corresponding to the generated entropy source using a third oscillating signal; and a third oscillator and a control unit which control the first and second oscillators and generate the third oscillating signal. The frequency of the third oscillating signal is lower than the first and second frequencies.
Abstract translation: 根据本发明实施例的随机数发生器包括：产生具有第一频率的第一振荡信号的第一振荡器; 产生具有与第一频率不同的第二频率的第二振荡信号的第二振荡器; 接收第一和第二振荡信号的采样单元，通过组合输入的第一和第二振荡信号产生至少一个熵源，并使用第三振荡信号对与所生成的熵源相对应的比特进行采样; 以及第三振荡器和控制单元，其控制第一和第二振荡器并产生第三振荡信号。 第三振荡信号的频率低于第一和第二频率。
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3.发明授权메모리를 감소시키는 개선된 룩업 테이블 압축방법 및이를 이용하여 압축된 룩업 테이블을 가지는 비선형 함수발생장치 및 그 발생방법 失效用于减小存储器的查找表的改进方法和具有使用该方法和非线性函数生成方法压缩的查找表的非线性函数发生装置
公开(公告)号：KR100498457B1
公开(公告)日：2005-07-01
申请号：KR1020020069658
申请日：2002-11-11
Applicant: 삼성전자주식회사
Inventor： 이헌수
CPC classification number: H03M7/30
Abstract: 메모리를 감소시키는 개선된 룩업 테이블 압축방법 및 이를 이용하여 압축된 룩업 테이블을 가지는 비선형 함수 발생장치 및 그 발생방법이 개시된다. 본 발명에 의한 메모리를 감소시키는 개선된 룩업 테이블 압축방법은, 기울기 변화가 감소하는 비선형 함수 발생장치의 룩업 테이블 압축방법에 있어서, (a) 비선형 함수의 X좌표들을 소정의 좌표 간격을 가지는 스텝을 각각 포함하는 복수개의 구간들로 분할하는 단계; (b) 상기 각 스텝별 X좌표 값에 대응하는 Y좌표 값을 추출하는 단계; 및 (c) 상기 각 구간의 스텝별 X좌표 값 및 상기 Y좌표 값들을 메모리 내의 지정된 주소에 저장하는 단계를 포함하며, 스텝의 좌표 간격은 복수개의 구간들에 대하여 다르게 설정되는 것을 특징으로 한다.
본 발명에 의한 룩업 테이블 압축방법 및 이를 이용하여 압축된 룩업 테이블을 가지는 비선형 함수 발생장치 및 그 발생방법에 의하면, 룩업 테이블이 차지하는 메모리의 용량을 줄일 수 있는 장점이 있다.-
公开(公告)号：KR100155968B1
公开(公告)日：1998-12-15
申请号：KR1019950003119
申请日：1995-02-18
Applicant: 삼성전자주식회사
Inventor： 이헌수
IPC: G11B27/02
Abstract: 본 발명은 더블데크의 자동 편집회로 및 그 제어방법에 관한 것으로서, 원테이프의 총 소요시간과 목표테이프의 총 소요시간의 서로 상이한 경우, 원테이프의 정보가 목표테이프에 기록되는 도중 소실되는 것을 방지하기 위하여 제1 데크상에 장착된 원테이프를 재생하는 제1 헤드와 제1 데크상에 장착된 원테이프를 소정방향으로 이송시키는 제1 모터제어기 및 제1 데크상에 장착된 원테이프의 총 소요시간을 체크하는 타이밍수단으로 구성된 제1 제어수단과, 제2 데크상에 장착된 목표테이프에 새로운 정보를 기록하는 제2 헤드와 제2 데크상에 장착된 목표테이프를 소정방향으로 이송시키는 제2 모터기 및 제2 데크상에 장착된 목표테이프내의 총 소요시간을 체크함과 동시에 원테이프의 정보를 목표테이프에 기록시 곡간의 간격을 제어하는 시간제어� ��단으로 구성된 제2 제어수단, 및 제1 제어수단에 제어신호를 출력하고 제2 제어수단에 제어신호를 출력하여 원테이프의 길이와 목표테이프의 길이차에 해당하는 량만큼 기록되는 곡수를 제어하는 마이크로 컴퓨터를 구비하였다.
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Patent Agency Ranking
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公开(公告)号：KR1020150145854A
公开(公告)日：2015-12-31
申请号：KR1020140075099
申请日：2014-06-19
Applicant: 삼성전자주식회사
CPC classification number: G06F21/6218 , G06F21/72 , G06F21/805 , G06F21/85 , G06F2221/2107
Abstract: 저장장치를제어하는호스트컨트롤러는, 시스템메모리와통신하는시스템메모리인터페이스, 저장장치와통신하는저장장치인터페이스, 시스템메모리로부터저장장치에기입되는데이터를암호화하는암호화부, 및프로세서에의해제공된커맨드를분석하여상기커맨드로부터파일암호화정보및 디스크암호화정보를추출하고, 파일암호화정보에기초하여파일암호화동작을선택적으로수행하도록암호화부를제어하고, 디스크암호화정보에기초하여디스크암호화동작을선택적으로수행하도록암호화부를제어하는제어부를포함한다. 이에따라, 호스트컨트롤러가파일암호화기능및 디스크암호화기능을지원하므로, 저장장치의보안이강화될수 있다.
Abstract translation: 一种用于控制存储装置的主机控制器，包括：用于与系统存储器通信的系统存储器接口; 用于与存储装置通信的存储装置接口; 编码单元，用于对从系统存储器写入存储装置的数据进行编码; 以及控制单元，用于分析由处理器提供的命令以从命令中提取文件编码信息和盘编码信息，控制编码单元基于文件编码信息选择性地执行文件编码操作，并且选择性地控制编码单元 基于盘编码信息执行盘编码操作。 因此，主机控制器支持精细编码功能和盘编码功能，并且可以增强存储装置的安全性。
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公开(公告)号：KR1020150104924A
公开(公告)日：2015-09-16
申请号：KR1020140026914
申请日：2014-03-07
Applicant: 삼성전자주식회사
CPC classification number: G06F21/57 , G06F21/64 , G06F21/79 , G06F2221/034 , G06F2221/2139
Abstract: 전자 시스템은 메모리 장치, CPU 및 무결성 검증 장치를 포함한다. 메모리 장치는 복수의 검증 데이터들을 저장한다. CPU는 복수의 검증 데이터들 각각에 상응하는 시작 주소, 길이 정보 및 기준 해시값을 포함하는 복수의 설정 레코드들을 제공한다. 무결성 검증 장치는 CPU로부터 수신되는 복수의 설정 레코드들을 저장하고, 복수의 설정 레코드들 각각을 순환하여 선택하고, 선택된 설정 레코드에 포함되는 시작 주소 및 길이 정보에 기초하여 메모리 장치에 직접 접근하여 메모리 장치로부터 선택된 설정 레코드에 상응하는 검증 데이터를 독출하고, 검증 데이터에 대해 해시 연산을 수행하여 검증 해시값을 생성하고, 검증 해시값과 선택된 설정 레코드에 포함되는 기준 해시값에 기초하여 인터럽트 신호를 생성한다.
Abstract translation: 电子系统包括：存储装置，CPU和完整性验证装置。 存储装置存储多个验证数据。 CPU提供多个设置记录，包括与每个验证数据对应的起始地址，长度信息和参考散列值。 完整性验证装置存储从CPU接收的建立记录，循环地选择每个建立记录，基于开始直接访问存储装置，从存储装置读取对应于所选建立记录的验证数据 包括在所选择的设置记录中的地址和长度信息通过对验证数据执行哈希计算来产生验证哈希值，并且基于包括在验证散列值和所选择的设置中的参考哈希值来生成中断信号 记录。
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9.发明公开보안 관리 유닛, 상기 보안 관리 유닛을 포함하는 호스트 컨트롤러 인터페이스, 상기 호스트 컨트롤러 인터페이스의 동작 방법, 및 상기 호스트 컨트롤러 인터페이스를 포함하는 장치들 审中-实审安全管理单元，主机控制器接口，包括它们的主机接口，用于操作主机控制器接口的方法，以及包括主机控制器接口的设备
公开(公告)号：KR1020140067180A
公开(公告)日：2014-06-05
申请号：KR1020120116890
申请日：2012-10-19
Applicant: 삼성전자주식회사
CPC classification number: G06F21/604 , G06F3/0622 , G06F3/0637 , G06F3/0673 , G06F21/62 , G06F21/629 , G06F21/78
Abstract: An operation method of a host controller interface includes the steps of receiving a buffer descriptor including sector information from a main memory; patching the data by using a source address included in the buffer descriptor; selecting one among the multiple entries included in a security policy table by using the sector information; and determining whether to encrypt the data which is patched by using the security policy included in the selected entry.
Abstract translation: 主控制器接口的操作方法包括从主存储器接收包括扇区信息的缓冲器描述符的步骤; 通过使用缓冲区描述符中包含的源地址来修补数据; 通过使用扇区信息在安全策略表中包括的多个条目中选择一个; 以及通过使用包括在所选择的条目中的安全策略来确定是否加密被修补的数据。
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公开(公告)号：KR1020100138586A
公开(公告)日：2010-12-31
申请号：KR1020090057179
申请日：2009-06-25
Applicant: 삼성전자주식회사
CPC classification number: G06F21/74 , G06F12/1491
Abstract: 본발명의반도체장치의액세스제어방법은, 입력된패스워드를해쉬연산기의입력으로제공하고, 해쉬연산기에서해쉬연산을수행하여제1 해쉬값을출력하고, 제1 해쉬값및 불휘발성메모리에저장된제2 해쉬값이일치하지않을때 상기제1 해쉬값을상기해쉬연산기의입력으로제공하여해쉬연산기에서상기해쉬연산을반복수행하도록제어하고, 그리고제1 및제2 해쉬값들이일치할때 해쉬연산기의해쉬연산의반복횟수에따라서내부회로에대한액세스레벨을설정한다.
Abstract translation: 目的：提供具有多重访问级别及其访问控制方法的半导体器件，以通过输入密码来限制访问范围。 构成：散列算子（330）输出第一个散列值。 非易失性存储器（310）存储第二哈希值。 安全JTAG（联合测试动作组）控制器（320）提供从外部输入的密码作为散列算子的输入。 当从散列算子输出的第一哈希值与保存在非易失性存储器中的第二哈希值相同时，安全JTAG控制器通过散列操作的重复频率设置关于内部电路的访问级别。
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