Abstract:
Pour le chiffrement de données à stocker dans une mémoire (23) externe à un circuit, on prévoit de stocker dans la mémoire externe des mots de données chiffrés (Ci) en association avec un vecteur d'initialisation (IVi) et un identificateur de clé (KIDi) associé à une clé secrète (Ki) ayant servi à le chiffrer.
Abstract:
L'invention concerne un procédé d'autorisation d'accès à une table de correspondance (10) d'adresses entre une unité centrale de traitement (1) multitâches et au moins une mémoire (4) contenant plusieurs programmes, consistant à calculer, à chaque changement de tâche de l'unité centrale, une signature d'au moins une partie des lignes d'instruction du programme et à vérifier la conformité de cette signature avec une signature enregistrée lors d'une exécution précédente du programme concerné.
Abstract:
The integrated processor coding chops digital word streams into predetermined sizes and generates key codes (Cb) generated pseudo randomly (10). The codes operate from a key function (K) and vector initialisation (IV) which changes for each block. The digital word blocks and key codes are combined continuously and memorised in a memory (23).
Abstract:
L'invention concerne un procédé d'autorisation d'accès à une table de correspondance (10) d'adresses entre une unité centrale de traitement (1) multitâches et au moins une mémoire (4) contenant plusieurs programmes, consistant à calculer, à chaque changement de tâche de l'unité centrale, une signature d'au moins une partie des lignes d'instruction du programme et à vérifier la conformité de cette signature avec une signature enregistrée lors d'une exécution précédente du programme concerné.
Abstract:
L'invention concerne un compteur monotone croissant sur n bits réalisés en circuit intégré, comportant : un ensemble de 2 n+1 -(n+2) cellules de comptage irréversible (11) réparties en au moins n groupes de 2 p -1 cellules de comptage, où p désigne le rang du groupe ; et au moins n-1 calculateurs (40) de parité, chaque calculateur fournissant un bit de rang p, croissant à partir du bit de poids le plus fort du compte résultat, prenant en compte les états des cellules du groupe de même rang.
Abstract:
L'invention concerne un circuit (4) de contrôle du caractère aléatoire d'un flux de bits, comportant un registre d'entrée (41) à décalage recevant le flux de bits et dont les sorties sont exploitées en parallèle, au moins un élément de comparaison (42) du contenu au moins partiel du registre d'entrée par rapport à des motifs prédéterminés (PATT), une pluralité de compteurs (CNT) en nombre au plus égal au nombre de motifs prédéterminés, et un élément de détection (44) du dépassement d'au moins un seuil par l'un des compteurs, le résultat de cette détection conditionnant l'état d'un mot ou bit (VAL) indicateur du caractère aléatoire ou non du flux de bits.