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    Mischerschaltkreis und Verfahren
    51.
    发明专利
    Mischerschaltkreis und Verfahren 未知

    公开(公告)号：DE102007029924B4

    公开(公告)日：2017-03-09

    申请号：DE102007029924

    申请日：2007-06-28

    Applicant: INFINEON TECHNOLOGIES AG

    Inventor： MARSILI STEFANO ,  TIEBOUT MARC

    IPC: H04B1/44 ,  H04B1/04 ,  H04B17/18 ,  H04L27/26

    Abstract: Ein Mischerschaltkreis (20), umfassend: einen Frequenzmischer (25) mit Eingangsklemmen und einer Ausgangsklemme, der konfiguriert ist, um ein lokales Oszillatorsignal durch Mischung von Eingangssignalen, die an den Eingangsklemmen bereitgestellt werden, an seiner Ausgangsklemme bereitzustellen, wobei der Frequenzmischer (25) ein Leck von einer der Eingangsklemmen in die Ausgangsklemme aufweist; einen Signalgenerator (26), der an eine der Eingangsklemmen des Frequenzmischers (25) gekoppelt ist und der konfiguriert ist, ein Korrektursignal zu generieren und bereitzustellen; einen Aufwärtswandlungsmischer (21), der an den Frequenzmischer (25) gekoppelt ist und der konfiguriert ist, um ein aufwärtsgewandeltes Signal durch Mischung eines Testsignals (ftest) mit dem lokalen Oszillatorsignal zu generieren; einen Abwärtswandlungsmischer (24), der an den Aufwärtswandlungsmischer (21) gekoppelt ist und der konfiguriert ist, um ein abwärtsgewandeltes Signal durch Abwärtsmischung des aufwärtsgewandelten Signals mit einem lokalen Oszillatorsignal, das die gleiche Frequenz wie das von dem Frequenzmischer (25) bereitgestellte lokale Oszillatorsignal aufweist, zu generieren; einen Signaldetektor (28), der an den Abwärtswandlungsmischer (24) gekoppelt ist und der konfiguriert ist, um ein verfälschtes Signal im abwärtsgewandelten Signal nachzuweisen, wobei das verfälschte Signal das Leck angibt; und eine Steuereinheit (29), die an den Signaldetektor (28) und den Signalgenerator (26) gekoppelt ist und die konfiguriert ist, um die Generation des Korrektursignals in Abhängigkeit von dem nachgewiesenen verfälschten Signal zur Kompensation des Lecks zu steuern.

    System und Verfahren für einen spannungsgesteuerten Oszillator
    52.
    发明专利
    System und Verfahren für einen spannungsgesteuerten Oszillator 未知

    公开(公告)号：DE102015212090A1

    公开(公告)日：2016-01-07

    申请号：DE102015212090

    申请日：2015-06-29

    Applicant: INFINEON TECHNOLOGIES AG

    Inventor： BEVILACQUA ANDREA ,  TIEBOUT MARC

    IPC: H03B5/12 ,  H03B5/08

    Abstract: Gemäß einer Ausführungsform umfasst ein Oszillator eine Tankschaltung und eine Oszillatorkernschaltung mit mehreren über Kreuz geschalteten Verbundtransistoren, die mit der Tankschaltung gekoppelt sind. Jeder der mehreren Verbundtransistoren umfasst einen Bipolartransistor und einen Feldeffekttransistor (FET) mit einer Source-Elektrode, die mit der Basis des Bipolartransistors gekoppelt ist.

    Verstärker
    53.
    发明专利
    Verstärker 未知

    公开(公告)号：DE102013103754B3

    公开(公告)日：2014-10-09

    申请号：DE102013103754

    申请日：2013-04-15

    Applicant: INFINEON TECHNOLOGIES AG

    Inventor： TIEBOUT MARC

    IPC: H03F1/08

    Abstract: Verstärker, umfassend: einen Eingangsanschluss zum Empfangen eines zu verstärkenden Signals (s1; Vi), einen Ausgangsanschluss (316) zum Ausgeben eines verstärkten Signals (s2; Vo), einen Steuereingang zum Empfangen eines Steuersignals (V1, Vb) zum Einstellen einer Verstärkung des Verstärkers, und eine Transistoranordnung (21) umfassend einen ersten Transistor (24; 34), wobei ein erster Lastanschluss des ersten Transistors (24; 34) mit dem Eingangsanschluss verbunden ist, wobei ein zweiter Lastanschluss des ersten Transistors mit dem Ausgangsanschluss verbunden ist, und wobei ein Steueranschluss des ersten Transistors (24; 34) mit dem Steuereingang verbunden ist, und eine erste zusätzliche Kapazität (27; 37), welche zwischen den ersten Lastanschluss des ersten Transistors (24; 34) und den zweiten Lastanschluss des ersten Transistors (24; 34) gekoppelt ist, wobei die Transistoranordnung (21) weiter einen zweiten Transistor (23; 33) umfasst, wobei ein erster Lastanschluss des zweiten Transistors (23) mit dem ersten Lastanschluss des ersten Transistors (34) und mit dem Eingangsanschluss verbunden ist, wobei ein Steueranschluss des zweiten Transistors (23; 33) mit einer festen Spannung (V2; 312) verbunden ist, und wobei ein zweiter Lastanschluss des zweiten Transistors (23; 33) mit einer Versorgungsspannung (V3; 318) verbunden ist.

    57.
    发明专利
    未知

    公开(公告)号：DE102007029924A1

    公开(公告)日：2008-02-14

    申请号：DE102007029924

    申请日：2007-06-28

    Applicant: INFINEON TECHNOLOGIES AG

    Inventor： MARSILI STEFANO ,  TIEBOUT MARC

    IPC: H04B1/44 ,  H04B1/04 ,  H04L27/26

    Abstract: A mixer circuit includes a mixer having input terminals and an output terminal, to provide an output signal by mixing input signals, wherein the mixer exhibits leakage. The circuit also includes a signal generator coupled to one of the input terminals of the mixer to provide a correction signal, an up-conversion mixer coupled to the mixer to provide an up-converted signal by mixing a test signal with the output signal of the mixer, and a down-conversion mixer coupled to the up-conversion mixer to provide a down-converted signal by down-converting the up-converted signal. A signal detector is coupled to the down-conversion mixer and detects a spurious signal in the down-converted signal, the spurious signal indicating the leakage, and a control unit is coupled to the signal detector and the signal generator to control generation of the correction signal depending on the detected spurious signal to compensate the leakage.

    58.
    发明专利
    未知

    公开(公告)号：DE102004052868B4

    公开(公告)日：2007-02-08

    申请号：DE102004052868

    申请日：2004-11-02

    Applicant: INFINEON TECHNOLOGIES AG

    Inventor： STREIBL MARTIN ,  TIEBOUT MARC ,  KIENMAYER CHRISTOPH ,  HODEL UWE ,  BENETIK THOMAS

    IPC: H01L23/60 ,  G11C7/10 ,  H03H7/00

    Abstract: Integrated circuit arrangement having first and second signal input pads, to which a differential input signal is applied, and first and second signal outputs, at which a differential output signal is provided. The first signal output is coupled to the first signal input pad and the second signal output is coupled to the second signal input pad. A first capacitance is between the first and second signal input pads. First and second inductances are connected in series, are between the first and second signal input pads, and are connected in parallel with the first capacitance. A first terminal is at a first supply potential and a second terminal is at a second supply potential. A first electrostatic discharge element is between the first and second terminals. A second electrostatic discharge element is between the first terminal, on the one hand, and the first and second inductances, on the other hand.

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