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    REGISTER MAPPING TECHNIQUES FOR EFFICIENT DYNAMIC BINARY TRANSLATION
    1.
    发明申请
    REGISTER MAPPING TECHNIQUES FOR EFFICIENT DYNAMIC BINARY TRANSLATION 审中-公开
    用于有效动态二进制翻译的注册映射技术

    公开(公告)号：WO2011159739A3

    公开(公告)日：2012-04-05

    申请号：PCT/US2011040406

    申请日：2011-06-14

    Applicant: INTEL CORP ,  OTTONI GUILHERME D ,  WANG HONG ,  LI WEI

    Inventor： OTTONI GUILHERME D ,  WANG HONG ,  LI WEI

    IPC: G06F9/45 ,  G06F9/24 ,  G06F9/30

    CPC classification number: G06F8/441 ,  G06F9/45525

    Abstract: Generally, the present disclosure provides a system and method for mapping registers from a system with more registers to a system with fewer registers. Regions may be formed that include one or more blocks of code with relatively frequent register accesses. The most frequently accessed source registers may be mapped to target registers. Each block in the region may be bounded by a prologue and at least one epilogue. The prologue may be configured to implement register mapping and the epilogue(s) may be configured to manage program flow from a block in the region to another block in the region or to a block not in the region.

    Abstract translation: 通常，本公开提供了一种用于将具有更多寄存器的系统的寄存器映射到具有较少寄存器的系统的系统和方法。 可以形成包括具有相对频繁的寄存器访问的一个或多个代码块的区域。 最常访问的源寄存器可能被映射到目标寄存器。 该区域中的每个块可以由前序和至少一个结尾界定。 序言可以被配置为实现寄存器映射，并且结尾可以被配置为管理从该区域中的块到该区域中的另一块或者不在该区域中的块的程序流。

    SYSTEM, METHOD AND APPARATUS FOR DEPENDENCY CHAIN PROCESSING
    2.
    发明申请
    SYSTEM, METHOD AND APPARATUS FOR DEPENDENCY CHAIN PROCESSING 审中-公开
    用于依赖链处理的系统，方法和装置

    公开(公告)号：WO2006036504A2

    公开(公告)日：2006-04-06

    申请号：PCT/US2005032118

    申请日：2005-09-12

    Applicant: INTEL CORP

    Inventor： NARAYANASAMY SATISH ,  WANG HONG ,  SHEN JOHN ,  ROSNER RONI ,  ALMOG YOAV ,  SCHWARTZ NAFTALI ,  HOFLEHNER GEROLF ,  LAVERY DANIEL ,  LI WEI ,  TIAN XINMIN ,  GIRKAR MILIND ,  WANG PERRY

    IPC: G06F9/45

    CPC classification number: G06F8/443 ,  G06F8/433 ,  G06F8/451

    Abstract: Embodiments of the present invention provide a method, apparatus and system which may include splitting a dependency chain into a set of reduced-width dependency chains; mapping one or more dependency chains onto one or more clustered dependency chain processors, wherein an issue-width of one or more of the clusters is adapted to accommodate a size of the dependency chains; and/or processing in parallel a plurality of dependency chains of a trace. Other embodiments are described and claimed.

    Abstract translation: 本发明的实施例提供了一种方法，装置和系统，其可以包括将依赖链分解成一组缩减宽度的依赖性链; 将一个或多个依赖关系链映射到一个或多个聚类依赖链处理器上，其中一个或多个所述簇的问题宽度适于适应所述依赖关系链的大小; 和/或并行处理多个跟踪的依赖性链。 描述和要求保护其他实施例。

    Techniken zum Koordinieren von Vorrichtungshochfahrsicherheit
    3.
    发明专利
    Techniken zum Koordinieren von Vorrichtungshochfahrsicherheit 未知

    公开(公告)号：DE112015007220T5

    公开(公告)日：2018-09-20

    申请号：DE112015007220

    申请日：2015-12-24

    Applicant: INTEL CORP

    Inventor： YAO JIEWEN ,  ZIMMER VINCENT J ,  LI WEI ,  POORNACHANDRAN RAJESH ,  MUDUSURU GIRI P

    IPC: G06F21/57

    Abstract: Techniken zum Bereitstellen und Erhalten des Schutzes von Firmwareroutinen, die Teil einer Vertrauenskette durch aufeinander folgende Verarbeitungsumgebungen bilden. Eine Einrichtung kann umfassen: eine erste Prozessorkomponente (550); einen mit der ersten Prozessorkomponente gekoppelten flüchtigen Speicher (562); eine Inselkomponente, um, in einer Vor-BS-Betriebsumgebung, eine sichere Insel innerhalb eines Teils des flüchtigen Speichers zu erzeugen, um Zugriff auf die in die sichere Insel geladene gesicherte Firmware einzuschränken; einen ersten Firmwaretreiber (646), um, in der Vor-BS-Betriebsumgebung, eine erste API bereitzustellen, um es nicht gesicherter Firmware zu ermöglichen, eine Unterstützungsroutine der gesicherten Firmware von außerhalb der sicheren Insel aufzurufen; und einen zweiten Firmwaretreiber (647), um, in einer BS-Betriebsumgebung, die die Vor-BS-Betriebsumgebung ersetzt, eine zweite API bereitzustellen, um es einem BS der BS-Betriebsumgebung zu ermöglichen, die Unterstützungsroutine von außerhalb der sicheren Insel aufzurufen.

    System, Vorrichtung und Verfahren zum Selbsstest vor Ort in einem Diagnose-Ruhezustand
    7.
    发明专利
    System, Vorrichtung und Verfahren zum Selbsstest vor Ort in einem Diagnose-Ruhezustand 未知

    公开(公告)号：DE102018125236A1

    公开(公告)日：2019-05-29

    申请号：DE102018125236

    申请日：2018-10-12

    Applicant: INTEL CORP

    Inventor： SHANBHOGUE VEDVYAS ,  HUXEL JEFF ,  LI WEI ,  MONDAL SANJOY ,  RAMAN ARVIND

    IPC: G06F11/22

    Abstract: Bei einer Ausführungsform umfasst ein Prozessor mindestens einen Kern und eine Schnittstellenschaltung zum Verbinden des mindestens einen Kerns mit zusätzlicher Schaltung des Prozessors. Als Reaktion auf eine Anweisung zum Selbsttest vor Ort kann mindestens ein Kern einen Zustand in einem Energiesparspeicher speichern, in einen diagnostischen Ruhezustand eintreten und einen Selbsttest vor Ort im diagnostischen Ruhezustand ausführen, in dem der mindestens eine Kern inaktiv zu sein scheint. Weitere Ausführungsformen sind beschrieben und beansprucht.

    REGISTER MAPPING TECHNIQUES FOR EFFICIENT DYNAMIC BINARY TRANSLATION
    8.
    发明专利
    REGISTER MAPPING TECHNIQUES FOR EFFICIENT DYNAMIC BINARY TRANSLATION 未知

    公开(公告)号：SG176872A1

    公开(公告)日：2012-01-30

    申请号：SG2011093044

    申请日：2011-06-14

    Applicant: INTEL CORP

    Inventor： OTTONI GUILHERME D ,  WANG HONG ,  LI WEI

    Abstract: 5 Generally, the present disclosure provides a system and method for mappingregisters from a system with more registers to a system with fewer registers. Regions may be formed that include one or more blocks of code with relatively frequent register accesses. The most frequently accessed source registers may be mapped to target registers. Each block in the region may be bounded by a prologue and at least one10 epilogue. The prologue may be configured to implement register mapping and theepilogue(s) may be configured to manage program flow from a block in the region to another block in the region or to a block not in the region.(Fig. 1)

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