Abstract:
본발명의일 실시예에따른간섭신호제거장치는입력신호를수신하는안테나, 입력신호를제1 신호및 제2 신호로분배하는증폭부, 제1 신호의대상주파수영역의신호에대한위상을미리지정된수치만큼변화시키는제1 위상변환기, 제2 신호의대상주파수영역의신호에대한위상을미리지정된수치만큼변화시키는제2 위상변환기, 제1 신호와제2 신호의지연시간이동일하도록및 상기제2 신호중 하나이상을보정하는타이밍제어기; 및위상이변화된제1 신호및 제2 신호에대한차분신호를생성하는뺄셈부를포함한다.
Abstract:
본 발명은 안테나와 송수신 칩 및 디지털 신호처리 칩을 하나의 패키지로 소형화, 집적화, 경량화하기 위해 단일 기판 위에 안테나와 레이더 온 칩으로 패키징하는 밀리미터파용 레이더 온 패키지에 관한 것으로, 밀리미터파용 레이더 온 패키지는, 다층 기판; 상기 다층 기판의 일면에 배치되는 RFIC 송신 모듈과 RFIC 수신 모듈로 구성되는 RFIC 칩; 및 상기 다층 기판의 타면에 형성되어 안테나 송신부와 안테나 수신부를 구성하며, 유전체 공진기 안테나의 노출 영역인 다수의 멀티 어레이 안테나를 포함한다.
Abstract:
PURPOSE: A digital radio frequency reception apparatus is provided to reduce consumption power, area, and development costs by eliminating interference signals in a reception signal outputted from a rational decimator. CONSTITUTION: A mixer(140) eliminates IF(Intermediate Frequency) signals from output signals of a digital signal converter(130). An integer decimator(150) executes the integer decimeter of the phase-separated signal. A DC(Direct Current) offset compensator(160) eliminates DC(Direct Current) component from the processed signals. An IQ mismatch compensator(170) compensates phase errors of quadrature signal and in phase signal for the signal. A rational decimator(180) executes the rational decimation of the phase compensated signal. A channel selecting filter(190) eliminates interference signal from the signal.
Abstract:
PURPOSE: A capacitor with variable capacitance and a digital control oscillator thereof are provided to reduce power consumption or the area of a chip by reducing the use of a digital circuit block which is used for improving the frequency resolution of a digital phase locked loop frequency synthesizer. CONSTITUTION: A lamination structure(10) comprises a plurality of metal layers including a first metal layer(111) and a plurality of dielectric layers(121,122) which are inserted between a plurality of metal layers. A switching unit, which has at least one switch, is connected to at least one metal layer among the metal layers excluding the first metal layer. The first metal layer and one end of the switch are used as a positive terminal of the capacitor. Two or more capacitances are provided through the short-circuit and open control of the switch.
Abstract:
PURPOSE: A frequency adjustment loop is provided to form a lock state of the frequency adjustment loop within fast time by moving an output frequency of an oscillator to wanting frequency band. CONSTITUTION: An oscillator(140) controls an output frequency according to inputted control bit. A programmable divider(150) divides the output frequency of the oscillator according to varied dividing ratio. A counter unit(110) is inputted an output signal of the programmable divider and a reference frequency. The counter unit measures a clock number of the output signal of the divider in one period of the reference frequency. A frequency detector(120) outputs the value tacking out from the clock number outputted from the counter unit in a standard comparison value to a control bit of the oscillator. The programmable divider decides the divide ratio about the output signal of the oscillator by receiving a feedback the clock number outputted from the counter unit.
Abstract:
A multi-layer wiring coplanar waveguide is provided to minimize the loss of a coplanar waveguide and to maximize slow-wave effect by using an intermediate metal layer having a width less than that of a ground. An uppermost metal layer is designed with a ground(41)-signal(40)-ground(41). An intermediate layer(43) has a structure for maximizing volume where an electromagnetic wave propagates. A lowermost metal layer is used as a shield layer and connected through the ground of the uppermost metal layer, the intermediate layer, and the via-hole. The intermediate layer is comprised of a plurality of intermediate metal layers located at a lower of the ground of the uppermost metal layer. The intermediate metal layers have a width less than that of the ground.
Abstract:
본 발명은 필터 및 그 제작방법에 관한 것으로, Gm-C 밴드패스필터 IC를 구현함에 있어서 트랜지스터의 기생 캐패시턴스 성분으로 인한 필터의 동작특성 왜곡을 유효하게 보상하기 위해서 필터의 프로토타이프에 나타나는 인덕터와 캐패시터의 직렬조합에 대하여 자이레이터를 이용한 임피던스 인버터 동작을 적용하는 것을 특징으로 하는 능동필터 및 그 제작방법을 제공한다. 본 발명에 의하면 기생 캐패시턴스 성분으로 인한 필터의 동작특성 왜곡을 유효하게 제거할 수 있다. 능동필터, Gm-C 필터, 기생 캐패시턴스, 자이레이터, 임피던스 인버터
Abstract:
본 발명은 초고주파 집적회로에 사용되는 가변 가능한 수동소자에 관한 것으로서, 병렬 커패시터를 연결하여 버랙터의 직렬저항을 줄임으로써 높은 충실도를 가지도록 한 가변 수동소자 및 그 제조방법에 관한 것이다. 이러한 가변 수동소자는 버랙터와 상기 버랙터의 충실도보다 높은 충실도를 가지는 커패시터를 병렬로 연결함으로써, 버랙터의 직렬저항을 감소시키고 소자 전체의 충실도를 향상시킨다. 이러한 높은 충실도를 가지는 가변 수동소자를 이용하면, 전압제어발진기나 가변 정합회로, 가변 대역통과회로 등의 부품을 집적화할 수 있어서 높은 성능을 가지면서 가격은 낮출 수 있는 잇점이 있다.
Abstract:
PURPOSE: A high-Q poly-to-poly capacitor structure for RF ICs is provided to reduce an area of a lower electrode plate to lower parasitic capacitance by using an interdigit structure. CONSTITUTION: A lower electrode plate(23) of a capacitor is formed on a silicon substrate(21). The lower electrode plate(23) is formed with the first polysilicon layer. An upper electrode plate(25) is formed on the lower electrode plate(23). The upper electrode plate(25) is formed with the second polysilicon layer. The upper electrode plate(25) is connected with the first metal layer(28) through a plurality of contacts(27). A contact/the first metal layer/via layer(27/28/29) are sequentially laminated on the lower electrode plate(23). The second metal layer(31) is connected with the via layer(29). The first and the second metal layers(28,31) are connected to each other by using the via layer(29). The lower electrode plate(23) and the upper electrode plate(25) are formed within silicon oxide layers(22,24,26,30). The contact(29) and the first metal layer(28) are formed within the silicon oxide layers(22,24,26,30).